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회로』, 한빛미디어, 2005
3. 권오근 · 권준식 · 김용민, 『디지털공학 및 실험』, 인터비전, 2006.
4. 강안구 · 임석구 · 최지영, 『전자계산기 구조』, 한올출판사, 2007
5. M. Morris Mano, 『Digital Design』, http://matdol.hanseo.ac.kr, 2009.05.27
6. 미상,『플
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회로와 순서회로로 구성(컴퓨터 내부회로 구성)
게이트
논리회로의 기본적인 하드웨어 소자로, 두 개 이상의 입력단자와 1개의 출력단자를 가짐
기본 연산 : 논리곱(AND), 논리합(OR), 논리부정(NOT), 배타적논리합(택)
불 대수(Boolean algebra)
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회로와 블록 도는 그림 11-5와 같다.
3. 실험 기기 및 부품
586급 PC 한 대
FPGA package 1개
Logic tester
oscilloscope
4. 실험 과정
1.다음 그림 11-6과 같이 multiplexer를 구성하시오.
2. 입력 및 선택 선과 Enable을 다음 표 11-1과 같이 가했을 때 출력을 측정하시
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대수의 기본 개념과 기본연산, 이와 관련한 실제 논리 회로에서 사용하는 게이트와의 관계를 불 대수의 공리 및 논리식의 표현으로 살펴보고, 복잡한 논리식을 간단하게 간소화하는 방법에 대하여 학습한 후 실험실습을 통한 실무 활용능력
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1. 논리회로의 기초 및 응용
2. Boolean 대수와 논리식 간략화
실험 계산값, PSPICE값, 측정값 datasheet 1. 논리회로의 기초 및 응용
2. Boolean 대수와 논리식 간략화
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실험과정 Pspice로 구현
만 인가하였을 때
만 인가하였을 때
, 둘 다 인가하였을 때 제목 : 실험 23. 평형 브리지 회로
1. 실험 목적
2. 관련이론
3. 실험 준비물
5. 실험과정 Pspice로 구현
제목 : 실험 24. 중첩의 정리
1. 실험 목적
2
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74LS04, 74LS08, 74LS32, 74LS00, 74LS02 및 74LS86의 내부
기능을 확인하여라.
-74LS는 공통적인 수치이며, 교과서를 참고했을 때,
-04=Inverter
-08=AND
-32=OR
-00=NAND
-02=NOR
-86=Exclusive-OR
을 각각 나타낸다. 1. 실험 목적
2. 핵심 내용 정리
3. 예비 과제
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대수(Boolean Algebra)
1) 불 대수의 기본공식
2) 카르노도(Kamaugh Map 또는 K-Map)를 이용한 간략화
(1) 카르노도의 특징
(2) 변수가 2개인 경우
(3) 변수가 3개인 경우
2. 기본 논리 게이트(Logic Gate)
3. 조합논리회로
1) 특징
2) 반가산기(Half-Adder,HA)
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회로 설계 및 실습
-예비레포트-
2. 전원, DMM의 내부저항 측정장치 설계
Ⅰ. 배경 이론
Ⅱ. 설계 실습 계획
Ⅲ. 결론
전기회로 설계 및 실습
-결과레포트-
2. 전원, DMM의 내부저항 측정장치 설계
Ⅰ. 실험 목적 및 동기
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회로라 하고, 아래의 래더 다이어그램 처럼 동시에 운전_스위치와 정지_스위치를 동시에 눌러도 무여자 상태가 된다. 이러한 회로를 시동우선 자기유지회로라 한다. Ⅰ. 서 론
실험 목적
실험 배경 이론 개요
1. 부울 대수
2. 래더
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