|
스위치
로 조절한다. 이 것은 양의 부분과 음의 레벨부분이 대칭성을 갖는 구형,
정현, 삼각파에 있어 그 두 부분이 차지하는 비율을 조절하는 것을 뜻한
다.
16.TTL(PUSH)/CMOS(PULL) : TTL/CMOS 논리회로의 입력파형으로 고정
논리레벨을 갖는 파형을
|
|
|
논리라는 주제로 실험을 하였습니다. 이 실험의 목표는 디멀티플렉서를 이용한 다중 출력 조합 논리 회로의 설계, 오실로스코프를 이용하여 카운터-디코더 회로의 타이밍 다이어그램 작성으로 두고 있습니다. 우선 디멀티플렉서(DMUX)가 무엇
|
|
|
연산
4-3-1 래치(latch)와 플립플롭(flip-flop)
(1) 비동기식 S-R 래치(latch)
(2) 동기식 S-R 래치와 S-R 풀리풀롭
(3) D 래치와 D 풀리풀롭
(4) J-K 풀리풀롭
(5) T 풀리풀롭
4-3-2 레지스터와 카운터
(1) 레지스터(register)
(2) 카운터(counter)
|
|
|
5V를 입력할 경우 동작하지 않고, 0V(GND)일 경우 7 Segment가 모두 점등되어 8자가 나온다. 1. 논리게이트
2. 디지털 집적회로
3. 7 Segment
!!<결과레포트>!!
1. 목적
2. 이론
3. 사용기기 및 부품
4. 도면
5. 실험 및 실험결과
6. 고찰
|
|
|
논리수준 시뮬레이션
Ⅳ. 회로 시뮬레이션(SPICE)
Ⅴ. 컨테이너 터미널의 객체지향 시뮬레이션
1. 시스템 분석
2. 객체지향 시뮬레이션 방법
Ⅵ. 선박조종 시뮬레이션
1. 선박조종 시뮬레이션의 개념
2. 선박조종 컴퓨터시뮬레이션의 오
|
|
|
카운터 IC는 어떤 유형인가: SW출력, 1242, 또는 NBCD?
6. 실험 7의 파형패턴에 관하여 문제 5를 반복하시오.
7. 4bit-Synchronous counter를 설계하여 회로도와 파형으로 나타내시오. (simulation)
6. 필요한 결과
Clock
+5
0
1. FF 1 Q
+5
0
1. FF 2 Q
+5
0
그림 9-4
Clock
+5
|
|
|
끝낼 수 있었던 실험이었다. IC패키지가 어떤 게이트를 가지고 있고, Slide switch와 LED 회로연결을 이해만 했다면 쉽게 알아낼 수 있었던 결과였다. 1. 실험 목적
2. 자료 조사
3. 실험
1) 조건
2) 방법
3) 실험 결과
4. 결론 및 소감
|
|
|
논리와 컴퓨터 설계 -M.Morris Mano and Chaarles R.Kime
2) http://www.alldatasheet.co.kr (데이터시트)
3) http://www.encyber.com/search_w/bsearch.php?gs=ws&p=1&q=인코더
4) http://www.blitzlogic.com/7seg_89.htm
2. FPGA 보드 작동사진
1) 1번실험 사진(보드)
2) 2번실험 사진
3) 3번실험 사
|
|
|
카운터의 동작은 [그림 3]을 참고한다.
(a) 순차 논리 회로
(b) 타이밍도
[그림 2] 2비트 동기 2진 카운터
[그림 3] 2비트 동기 2진 카운터의 상태 변이도
카운터의 종류,
비동기 카운터, 동기 카운터, 병렬 입력 2진 카운터, 링 카운터, 존슨 카운터
3.
|
|
|
회로를 설계하여라.
2-level AND-OR(NAND-NAND) logic 회로도
(4) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계하여라.
= + + + =
= + + +
= ( + ) + (+)
= () +
다단계 조합 논리 회로도
(5) 4-비트 가산기 회로를 위의 전가산기 회로를
|
|
메뉴펼치기
