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기말 텀프로젝트로 만든것입니다.
여타 레포트 싸이트에서 받는 자료는 대부분 VHDL을 이용한 것인데
이것은 블록 다이어그램을 이용한 회로 구성 파일들을 통째로 압축했습니다.
알람/달력/초시계/오전오후기능이 모두 가능합니다.
모듈
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회로의 신뢰성
▶ Breadboard를 제작하여 3회 이상 시험하여 모두 동작하면 통과.
▶ 이론값과의 오차를 측정하여 동작 범위를 설정함.
(2) 회로구현의 시간과 재현성
▶ 회로를 설계함에 있어서 누구나 설계도를 보았을 때 적은 시간을 들여서 높
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너무 많이 흐르면 led가 나가 버리고 너무 적게 흐르면 밝기가 약해지거나 작동이 되지 않기 때문에 적절한 저항을 사용하는 것이 중요하다.
회로가 의외로 복잡하여 작동원리대로 숫자를 출력하는 것이 쉽지만은 않았다. 8421-> 1000, 100, 10, 1
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회로 실험을 통해서 많은 것을 배우고 있습니다. 물론 많이 힘든 것도 사실인데 그 만큼 머릿속에 많은 것이 남았고 생각하고 있습니다.
항상 배우는 자세로 열심히 하겠습니다.
좀 이르긴 하지만 즐거운 한가위 보내세요..^^: 1. 제목
5.
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1. 목적 : 순차적 논리회로의 기본 소자인 래치와 플립플롭의 여러 종류에 대한 기능의 차이를 알아보고 동작 조건을 확인한다.
2. 실험 준비물
- 직류전원장치 1대
- 오실로스코프 1대
- Function Generator 1대
- Bread Board 1대
- Quad 2 Input NAND Gate (7
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LED에 불이 들어오지 않았다. 처음에는 회로도를 잘못 구성했으리라 생각했는데 이상이 없었다. 파워서플라이의 문제라고 판단하고 다른 파워서플라이를 이용하여 보았으나 결과는 같았다. 그래서 전압을 올려보았더니 LED에 불이 들어왔다. 6
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논리적이고 과학적인 지적인 측면을 지나치게 강조하여 정의적인 측면을 간과하고 있다.
셋째 피아제의 인지발달 이론이 인간의 전 인지영역을 포괄하고 있지 않다는 사실이다. 다시 말하면, 수학적. 과학적. 사고의 발달에 관해서는 상당히
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논리회로와 메모리를 함께 구현할 수 있는 SOC 신기술을 개발하고 이를 채택한 ASIC 설계에 들어갔다. 도시바, 히타치 등 대부분 반도체 소자 업체들도 SOC개발에 주력하고 있고 표준화된 SOC 기반을 만들기 위해 적극적인 협력관계를 모색하고
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카운터에서 출력을 로 잡은 10진 Count-Down 카운터
(9) J-K F/F를 사용하여 10진 리플 카운터를 설계하라.
1. A플립플롭의 출력은 매 클록 펄스 때마다 상태를 바꾸므로 J와 K를 1로 하여 토글될 수 있도록 한다.
2. B플립플롭의 출력은 D플립플롭의 출
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가. 동기식 카운터(Synchronous Counter)
1) T 플립플롭을 이용한 동기식 카운터
동기식 카운터는 모든 플립플롭의 클럭 입력에 공통의 클럭 신호가 연결되기 때문에 의 지연 후에 플립플롭의 모든 출력이 동시에 변한다. 따라서 시간 지연이 매우
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