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실험은 전체적으로 공통 드레인, 공통 게이트 증폭기의 동작과 전압이득을 살펴보는 실험을 하였다. 공통 드레인 증폭기에서 가장 먼저 위상차가 없이 파형이 진행되는 특성을 관찰할 수 있었다. 이는 공통 소스 증폭기에서는 입력단()와 출
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[ERROR : 10731] 오류 발생.
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016. JFET 특성
017. JFET 바이어스 회로
018. JFET 바이어스 회로 설계
019. 공통 소스 트랜지스터 증폭기
020. 다단 증폭기 (RC 결합)
021. 공통 이미터 증폭기의 주파수 응답
022. 차동 증폭기 회로
023. 선형 연산 증폭기 회로
024. 능
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K=Q가 되므로 실험순서3에서와 같이 값이 변하지 않고 초기값을 유지한다.
초기값이 SET이면 SET을 유지하고 RESET이면 RESET을 유지한다. 실험에 사용된 부품
실험 회로도
데이터 및 관찰내용
결과 및 결론
비고 및 고찰
평가 및 복습 문제
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Q when ON
Q
실험순서 5:D 래치 회로에 관한 관찰 내용
회로도
상 태
결 과
Enable=H
→ LED blink
(D입력이 HIGH일 때, Latch가 set되고
D입력이 LOW일 때, Latch가 reset된다.)
Enable=L
Green LED ON상태
Yellow LED 에 연결된 Q을 short
→ LED OFF
Q을 다시 Yellow LED 에 연결
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시퀀스를 뛰어넘어서 구현되었다. 회로를 다시 확인해보고 소자도 바꾸어 보고 핀번호도 하나하나 확인해 보았지만 정상작동 되지 않앗다. 그래서 조교님의 입회하에 회로가 완성되었고, 정확한 실험과 정확한 결과를 볼 수 있었다. 마지막
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연결 해야 하는데 연결을 하면서도 합선 이라던가, 잘못된 핀번호에 꽂기 등 몇가지의 이유로 실험의 결과값이 제대로 나오지 않아 다시 실험을 하게 되어 시간이 지체 되었다.
2진/Excess-3코드 변환 회로를 구성하는 과정에서는 C0를 접지에 연
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1 0
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0
1
0
1
A0
1 1 1
1 1 1
0
1
1
0
A0
※첨부한 회로도는 PISPICE에서 아날로그 소자를 디지털소자로 대체한 회로도입니다.
실험 결과 : 2비트 비교기 (A≥B) 에 대한 결과 사진
1 0 1 1 => 0 0 1 0 1 => 1
0 0 0 0 => 1 1 1 1 1 => 1
결과 및 결론 : 이
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