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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 8주차 예비+결과(코드포함) Application_Design_I 7-segment and Piezo_Control
목차
1. 09_post.docx
2. 09_pre.docx
1. 09_post.docx
이번 주차 실험에서는 7-segment 디스플레이와 피에조 드라이버를 제
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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 9주차 예비+결과(코드포함) Application_Design_II Text-LCD Control.
목차
1. 10_post.docx
2. 10_pre.docx
1. 10_post.docx
10_post. docx는 전자전기컴퓨터설계실험2의 아홉 번째 주차 실험 결과를 정
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Design counter with Piezo -> 동작 검사
3) 0000 ~ 1001, 즉 0 ~ 9 까지 값을 가지는 4-bit bcd 입력을 받아서 single FND 를 제어하는 8-bit 신호 (‘점‘을 포함) out 을 출력하는 모듈
4) FND array 를 제어하기 위하여 다음과 같은 선언부 및 변수를 가지는 모듈
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Design counter with Piezo -> 동작 검사
3) 0000 ~ 1001, 즉 0 ~ 9 까지 값을 가지는 4-bit bcd 입력을 받아서 single FND 를 제어하는 8-bit 신호 (‘점‘을 포함) out 을 출력하는 모듈
4) FND array 를 제어하기 위하 에 해당하는 자세한 내용들을 작성해놓았
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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 6주차 예비+결과(코드포함) Sequential_Logic_Design_I Flip-Flop, Register and SIPO
목차
1. 07_post.docx
2. 07_pre.docx
1. 07_post.docx
07_post. docx 파일은 Sequential Logic Design I의 Flip-Flop, Register, SIPO(Sin
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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 4주차 예비+결과(코드포함) Combinational_Logic_Design_1 Arithmetic_Logic and Comparator
목차
1. Lab04(post).docx
2. Lab04(pre).docx
1. Lab04(post).docx
4주차 실험인 Combinational Logic Design 1의 주제는 산
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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 5주차 예비+결과(코드포함) Combinational_Logic_Design_II Decoder, Encoder and MUX
목차
1. 06_post.docx
2. Lab05(pre).docx
1. 06_post.docx
1 MUX는 4개의 입력 중 하나를 선택해 출력하는 역할을 한다.
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[전자전기컴퓨터설계실험2] A+ 서울시립대학교 전전설2 7주차 예비+결과(코드포함) 자판기 Sequential_Logic_Design_II FSM and Clocked_Counter
목차
1. 08_post.docx
2. 08_pre.docx
1. 08_post.docx
08_post. docx는 전자전기컴퓨터설계실험2의 7주차 예비 및
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서울시립대 전자전기설계2(전전설2) 8주차 결과보고서
목차
0. 기본 숙지 사항
1. 실습 1 4-bit up counter의 출력 값 single FND 표시
2. 실습 2 Piezo, 7-segment 설계
3. 실습 3 점을 포함한 8비트 신호의 7-segment 설계
4. 실습 4
5. 실습 5(binary to bcd co
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전전설2) 8주차 사전보고서
목차
0. 기본 숙지 사항
1. 7-segment decoder 설계
2. Dynamic 7-segment 컨트롤러 설계
3. Piezo 컨트롤러 로직 설계
4. 실습 1 4-bit up counter의 출력 값 single FND 표시
5. 실습 2 Piezo, 7-segment 설계
6. 실습 3 점을 포함한 8비
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