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(서울시립대 전전설3) [종합2등(A+), 성적증명] 3주차 예비레포트+MATLAB코드+LTSpice회로+교수님피드백 - 2nd Order RLC Circuit Frequency Responses
목차
I. Introduction
II. Summary of Theories
III. Pre-lab Report
IV. Concluding Remarks
I. Introduction
2차 RLC 회로
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(서울시립대 전전설3) [종합2등(A+), 성적증명] 5주차 결과레포트+MATLAB코드+실험데이터 - Practical Op-Amp Specifications
목차
I. Introduction
II. Experiment Setup
III. Experimental Results & Analysis
IV. Conclusion
I. Introduction
프랙티컬 오퍼레이션 앰프
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(서울시립대 전전설3) [종합2등(A+), 성적증명] 5주차 예비레포트+MATLAB코드+LTSpice회로+교수님피드백 - Practical Op-Amp Specifications
목차
I. Introduction
II. Summary of Theories
III. Pre-lab Report
IV. Concluding Remarks
I. Introduction
프랙티컬 연산증폭
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(서울시립대 전전설3) [종합2등(A+), 성적증명] 6주차 결과레포트+MATLAB코드+실험데이터 - Various Diode Characteristics
목차
I.Introduction
I.1.Purpose
II.Experiment Setup
II.1.Exper. 1) PN Diode
II.2.Exper. 2) Zener Diode
II.3.Exper. 3) Light Emitting Diode
II.4.Exper. 4)
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(서울시립대 전전설3) [종합2등(A+), 성적증명] 6주차 예비레포트+MATLAB코드+LTSpice회로 - Various Diode Characteristics
목차
1. Introduction
1) Goals
2) Purposes of documentation
2. Summary of Theories
1) Diode Characteristics
2) Types of Diodes
3. Pre-lab Report
1) P
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시립대 전전설2 Velilog 결과리포트 2주차
목차
1.실험 목적
2.배경 이론
1) Xilinx ISE의 특징
2) Xilinx ISE Design Entry
3) Xilinx ISE Compilation
4) Isim Simulator
5) AND Gate
3.실험 장비
1) 장비
2) 부품
4.실험 결과
1)AND
2) HalfAdder
5.결론 및
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서울시립대 전자전기설계2(전전설2) 6주차 결과보고서
목차
1.기본숙지사항
2.실습1 4비트 병렬 데이터 저장/전송 설계
3.실습2 코드에 변화 주기
4.실습3 코드에 변화 주기
5.4비트 sipo문 설계 설계
6.실습5 for문을 이용한 sipo 설계
7.
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시립대 전전설2 Velilog 결과리포트 7주차
목차
1. 실험 목적
2. 배경이론
3. 실험장비
4. 시뮬레이션 결과와 실험결과 비교
1) Dynamic 7 Segment
2) PIEZO PIANO
3) Count With PIEZO
5. 결론 및 고찰
1. 실험 목적
시립대 전전설2 Velilog
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서울시립대 전자전기설계2(전전설2) 7주차 결과보고서
목차
0. 기본 숙지 사항
1. 실습0 Synchronzied 신호 생성 코드 작성
2. 실습1 Moore머신 작성
3. Mealy머신 작성
4. 응용과제
5. 최종정리
0. 기본 숙지 사항
전자전기설계2(전전설
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시립대 전전설2 Velilog 결과리포트 5주차
목차
1.실험 목적
2.배경 이론
1)3x8 decoder
2) 21 MUX
3) 41 MUX
4) BCD Code (8421 코드)
5) Excess-3 Code ( 3초과코드 )
3.실험 장비
1) 장비
4.시뮬레이션 결과와 실험 결과의 비교
1)38Decoder
2)41Mux
3
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