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회로
5.예비 보고 사항
실험번호
제출일
제출자
실험조
학번
이름
7
2014. 10. 29.
그림7-9. 논리 회로
1) 그림7-9와 같이 논리 회로를 구성하였다. 소자 A와 B의 VOH, VOL, VIH, VIL 각각의 값이 다음과 같을 때, LOW 레벨 노이즈마진(NML)과 HIGH 레벨 노이즈마
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특성
12. 인덕턴스 특성
13. 브리지회로를 이용한 L,C 측정
14. R-L, R-C 회로 특성
17. 공진회로 특성
18. 오실로스코프의 x-y축 동작법
20. 회로망 정리의 검증
21. 필터회로 특성
23. 미분 및 적분회로
24. 다이오드의 기초
26. 다이오드 정류회로
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476이나 7474가 negative edge trigger 이기 때문이다. 그러므로 회로를 설계할때 up counter을 만들고 싶으면 앞단의 Q값을 다음단의 clock로 입력해주면 되고 down counter을 만들려면 값을 clock에 연결해주면 된다. 실험목적
실험준비물
예비과제
설계
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414
0.586
●시뮬레이션실험 값
<4차 필터 회 로 도>
1)500Hz
scale : 500us/Div
2)1000Hz
scale : 200us/Div
3)2000Hz
scale : 100us/Div
4)2680Hz
scale : 50us/Div
5)4000Hz
scale : 50us/Div
6)5000Hz
scale : 50us/Div
7)9000Hz
scale : 50us/Div
●실험 값
<4차 저역통과 필터 회로도(버터워
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실험을 통해 실제로 성립하는지 확인 하였다. 브리지 회로와 노드법과 메쉬법 이용한 해석
예비 보고서
1. 실험 목적
2. 실험 이론
(1) 브리지 회로
(2) 브리지를 이용한 저항 측정
(3) 평형 브리지
(4) 노드 분석법 (Nodal Analysis)
(5)
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실험할 FET실험도 사전에 FET에 대한 철저한 예비 공부와 그에따른 회로도 많이 공부해봐야 겠습니다. 1>기본이론(멀티바이브레이터,슈미트트리거회로)
2>사용기기와부품
3>실험내용과 방법
4>결과값및 고찰
5>이번실험을 통하여 느
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이득은 으로 구할 수 있다. 여기서 는 이다.- 과정5는 의 베이스에 같은 동상의 신호를 인가한 값으로, 같은 신호를 넣어 주었기 때문에 의 출력 또한 같은 신호가 나온다. 전압이득은 으로 구할 수 있다. 여기서 는 이다.이 실험은 차동증폭기
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실험을 통해 증폭기가 주파수에 따라 증폭률이 달라지는 원리와 상한 하한 주파수의 개념을 알 수 있었다. 주파수가 낮아지면 결합 커패시터와 단락 커패시터가 이득을 감소시키고, 주파수가 높아지면 트랜지스터 내부의 기생 커패시터들의
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회로
2.2.1 실험 회로도
PSPICE 회로도
브레드 보드 구성
2.2.2 실험 방법
1) 실험 회로 6-2의 회로를 구성하고 , 를 측정하여 , , 를 계산하라.
2) 위에서 얻은 값으로부터 , , 를 구하라.
3) 계산한 값을 예비 보고 사항에서 구한 값과 비교하라.
4) 트랜
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사용될 수 있습니다. 이 지연 시간은 클력 주파수를 변화시킴으로써 늘리거나 줄일 수 있습니다. 또한 데이터 비트의 자리이동을 통해 산술 및 논리연산을 수행할 수 있도록 합니다. 실험목적
실험준비물
예비과제
실험
설계 및 고찰
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