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전문지식 275건

부울 대수식을 간략화하기 위한 카르노 맵의 이용 ※ 우리가 원하는 임의의 논리 동작을 실현하기 위한 논리 회로를 설계하는 경우에 카르노 맵을 이용하여 부울 대수식을 단순화시키면 회로를 간략화 할 수 있다. ① 진리표 작성 ② 카르노
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  • 등록일 2005.05.29
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논리소자와 기억소자를 조합해 만든 전자회로에 의해 필요한 기능을 발휘하는 제어 장치이므로 제한된 기능만 수행하며 기능변경이 곤란하다. ② CNC 공작기계 - 프로그래밍만으로 쉽게 기능이 변경되므로 유연성이 높고 계산능력이 훨씬 크
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  • 등록일 2006.11.26
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컴퓨터 : PC/XT에서의 DMA 제어기, 시스템 타이머, 주소 디코딩 회로 등을 조합한 칩셋(chipset)으로 대체 되었다. 참고 도면 <부록> DRAM의 Refresh에 대한 검토 교재 332페이지 중간 리프레시(refresh). 저장 노드는 완벽하지 못하여 시간이 지나면
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  • 등록일 2002.11.03
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) (X+Y)' = X' · Y' (드모르간의법칙) (X·Y)' = X' + Y' (드모르간의법칙) X=X (대합성의법칙) X·(X+Y)=X (흡수법칙) X+X·Y=X (흡수법칙) X+X'·Y=X+Y (흡수법칙) ※ 논리회로 드모르간의 정리 - 부울의 대수 - - 회로도 - 1.부정 논리곱(NAND) 2. 부정 논리합(NOR) 
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  • 등록일 2008.12.22
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회로이다. 쌍대성 정리를 이용하여 (d)회로를 (e)와 같은 등가의 NOR-NOR 회로로 바꿀 수 있다. 즉, 주어진 논리 동작을 하는 회로를 (b)와 (e)처럼 2가지 종류로 만들 수 있다. 참고문헌 부울대수와 카르노 맵 - 정보통신실험 2004. 5. 19 디지털 공학실
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  • 등록일 2005.12.04
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bit 가 0 이므로 + 이다. 1.디지탈시스템의 개요 2.수의 표현 3.여러가지 부호 4.부울 대수 5.논리식의 간단화 6.기본적인 논리회로 7.멀티바이브레이터 회로 8. 시미터 트리거회로 9. 계수회로와 레지스터 10. Shift Register 10. 연산 장치
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  • 등록일 2012.03.13
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다른 회로의 전가산기를 구성하라. ●실험 목적 ●실험 원리 ○ 반가산기 (Half-Adder, HA) ○ 전가산기 (Full-Adder, FA) ○ 반감산기 (half subtracter , HS) ○ 전감산기 (full subtractor , FS) ● 결과보고서 ○ 비고 및 고찰 ○ 문제 ○ 고찰
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  • 등록일 2007.08.26
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컴퓨터 개요][논리 회로][자료의 표현과 연산][명령어 및 제어][중앙처리장치] [기억장치][연산장치와 마이크로 프로세서][입출력장치] 정보처리기능사 제2과목-패키지 활용 [프리젠테이션] [데이터베이스][스프레드 쉬트] 정보처리기능
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  • 등록일 2004.07.18
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. 최하위 bit 이기 때문에 올라오는 carry 값이 없기 때문. 4 실험 2의 다른 회로의 전가산기를 구성하라. - 전가산기의 부울대수식은 다음과 같다. S = A B C, C = AB + BC + AC 1.목적 2.원리 3.실험방법 4.문제풀이 5.실험결과 6.고찰
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  • 등록일 2004.09.16
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논리회로 이외에 센서와 액추에이터를 조합시킨 것으로서 인간을 대신할 수 있음. 4. 지각화/지능화 센서 센서의 기술적 도달목표로, 외계 정보를 감지, 입력하는 센서에 이 입력신호를 처리, 해 석 하는 마이크로프로세서를 내장시킴으로써
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  • 등록일 2003.10.29
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