|
논리회로 실험, 생능출판사
이순흠 외 3명(2008), 웹기반 디지털 논리회로 가상실험실의 교육효과, 한국컴퓨터교육학회
오윤정(2005), 부울대수와 논리회로 학습을 위한 웹 코스웨어 설계 및 구현, 전남대학교
최수정(2004), 조합논리회로 학습을
|
|
|
회로입니다.
입력 변수를 피감수는 A, 감수는 B, 아랫자리에서의 빌림수를 C라 하고, 출력은차 D와 현재 자리에서 발생한 빌림을 Bn이라 하면 진리표는표 4-9와 같다.표 4-9에서 3 변수 입력의 여덟 가지 조합에 대하여 차와 빌림수의 논리함수를
|
|
|
1. 조합논리회로
조합논리회로는 입력 신호의 조합에 따라 즉시 출력을 생성하는 논리회로의 한 유형으로, 메모리 요소를 포함하지 않는 것이 가장 큰 특징입니다. 즉, 조합논리회로의 출력은 오직 현재의 입력 신호에만 의존하며, 이전 상태
|
|
|
전기전자회로실험
- 실험6. 논리조합회로의 설계 -
1.개요
◎ 논리게이트 조합으로 복잡한 논리적 함수관계 구현 및 불필요하게 복잡한 논리를 단순화 시키는 K-map 응용 방법을 익히고 don’t care 조건을 다루는 예를 실습한다.
◎ 조
|
|
|
변화 제 1장 컴퓨터와 디지털 논리회로
제 2장 데이터 표현
제 3장 논리 게이트와 부울 대수
제 4장 부울대수 간소화 및 구현
제 5장 조합 논리회로
제 6장 순서 논리회로
제 7장 레지스터와 카운터
제 8장 기억장치와 PLD
|
|
|
저항을 앞에 달아주면 괜찮을 것 같았다. 다음실험에는 미리 회로구성과 핀번호같은 것을 충분히 숙지하고 실험에 임해야겠다. 디지털 공학 실험
6장 가산기와 ALU 그리고 조합논리회로 응용
결 과 보 고 서
1. 결과
2. 검토 및 고찰
|
|
|
회로이다. 디멀티플렉서는 멀티플렉서와 반대기능을 하는데, 하나의 입력선으로 정보를 받아서 여러 출력선으로 분배하는 기능을 한다.
멀티플렉서를 사용하면 조합 논리함수를 곱의 합 형식으로 만들어낼 수 있기 때문에 여러 개의 게이트
|
|
|
회로를 설계하여라.
2-level AND-OR(NAND-NAND) logic 회로도
(4) XOR gate를 이용하여 보다 간소화된 다단계 조합 논리 회로를 설계하여라.
= + + + =
= + + +
= ( + ) + (+)
= () +
다단계 조합 논리 회로도
(5) 4-비트 가산기 회로를 위의 전가산기 회로를
|
|
|
정리를 이용
Y=B+BC+ABC
=B+BC+BC+ABC
=B(C+)+BC(+A)
= B+BC
② 카르노 맵 이용방법
Y
AB
C
00
01
11
10
0
0
1
0
0
1
0
1
1
0
Y= B+BC 1. 부울대수
2. 부울대수의 기본공리
3. 부울대수의 제반 정리
4. 조합논리회로
5. 카르노 맵(Karnaugh Map)
6. 간략화해보기
|
|
|
0
1
1
(c) NOT 게이트
입력
출력
A
B
Y
0
0
1
0
1
1
1
0
1
1
1
0
(d) NAND 게이트
입력
출력
A
B
Y
0
0
1
0
1
0
1
0
0
1
1
0
(e) NOR 게이트
입력
출력
A
B
Y
0
0
0
0
1
1
1
0
1
1
1
0
(f) Exclusive-OR 게이트
조합논리회로의 설계
우선 원하
|
|
메뉴펼치기
