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전압)*(10^(-3)))] / [2.1*5*1000]
[위의 값*(6.9*(10^10))*0.04*0.003*0.003] / [6*0.1]
실험.3 고찰
-실험.3의 경우 위에서 말한 바와 같이 스트레인 게이지가 고장나서 실험을 진행하지 못하였다. 하지만, 조교님께서 주신 측정값을 통하여 검토 과정을 실시해봤
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회로에서 그림 11-7(a)의 회로와 그림 11-7(b)의 회로 사이에는 어 떠한 차이점이 있는가?
③ RC 고역통과 필터의 차단주파수에서 이득을 -3dB라고 할 때 /2 되는 주파수에서의 이득은 몇 dB가 되겠는가? 1. 실험목적
2. 관련이론
(1) 저역 통과 R
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실험을 할 때도 보드상에서 같은 영역을 사용하는 것으로 같은 과정이란 것을 확인할 수 있었다.
<그림 26> 전파정류기, LPF,전압비교기
<그림 27> BPF의 대역폭
마지막으로 PLL 때문에 까다로운 동기복조를 살펴보면, 구성은 PLL회로와 LPF
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실험 순서 1, 2의 결과를 보면 HIGH와 LOW의 이론값은 5V, 0V이지만 실험순서 1의 결과값은 5.07V, 0.12mV가 나왔고, 실험순서 2의 결과값은 4.50V, 0.12mV, 0.14mV 가 나오게 되었는데 이러한 원인으로는 전압원의 전압이 정확하지 못하였거나 회로에 존재하
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전압이 존재함을 알 수 있었다.
조별 토의에서 병렬공진회로에서의 실질적인 주파수에 따른 전압
그래프에 대한 이론적인 부분들을 이해하였으며, 직렬공진회로
와의 차이점들을 확인하였습니다. Ⅰ. 목적
Ⅱ. 실험 장치 및 부품
Ⅲ. 실
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회로
4)2차 고역 통과 필터 만(이득:2, 비반전)을 통한 이득과 파형형태 확인
5)차단 주파수 60Hz임을 확인한 실험
주파수(Hz)
출력 전압(V)
10
160m
20
200m
30
500m
40
900m
50
1.35
60
1.7
70
2.15
- 10Hz의 오차를 보였다. : 저항 1k -> 1.2k 로 수정하여 60Hz에서 정
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실험에서 재밌는 부분은 공급 전압 부분인데, 여기선 6V를 이용했는데 전압 값은 상관이 없다. 계산과정에서 약분이 되어 필요가 없기 때문이다. 하지만 공급전압이 0V이면 안된다, 그럼 아예 전류가 흐르지 않기 때문이다.
평형 브리지 회로
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가변저항을 이용해 이 회로를 이해 하는 것이 목적이었고
첫번째 실험은 2가지로 나뉘어졌다. 첫 번 째 는 전압BD를 0V를 맞췄어야했다. 그렇게 하기위해 가 0V로 만들어지도록 가변저항을 조절했다. 그런데 엄청난 실수를 범했다. 실험을 할
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실험에 대한 고찰 >
이번 실험은 정상상태의 직류 회로망에서 캐퍼시터의 작용과 캐퍼시터에 걸리는 전압이 지수함수로 증가함을 실험을 통해 직접 확인해보았고, 또 직렬 및 병렬 연결된 캐퍼시터의 전체 용량에 관한 기본 방정식을 증명
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실험에서 구성하는 회로에서는 CMOS 논리를 사용한가, IC에 정전기로 인한 손상이 발생하지 않도록 참고문헌의 주의 항을 따르기 바란다,
■ 실험 순서
1. 그림 7-1의 회로를 구성하라. 이번 실험 전체에 대한 전원전압은 +0.5로 설정한 모든 IC의 V
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