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JK 입력 상태에 따른 Q 출력 파형을 그려라.
CLK
J
K
Q
2) 다음의 진리치표를 갖는 T-FF 회로는 JK-FF를 사용하여 구성하라.
T
0
1
[여기표]
T
J
K
0
0
0
0
×
0
1
1
×
0
1
0
1
1
×
1
1
0
×
1 1.제목
2.목적
3.이론및 실험원리
4.실험장치
5.실험방법
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때) logic state는 일반적으로 high이다.
.LED가 off 일때(불이 꺼졌을 때) logic state는 일반적으로 low이다.
.입력과 출력 회로의 logic state는 전압계나 오실로스코프로 알 수 있다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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지정된 VT+와 VT-에서만 state를 변화시킨다. ; VT+와 VT-사이에서의 입력 신호는 locked out이다.
.SChmitt-trigger gate는 아날로그 input waveform을 square 디지털 output waveform으 로 전환한다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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high또는 low를 쓸수 없게 할수 없다.
.two-input XOR gate는 input이 pulled high의 하나라면 완전하게 수행한다.
.two-input XNOR gate는 input이 pulled low의 하나라면 완전하게 수행한다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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clocked되기 전이나 후에 안정되어야 한다.
.timing diagram은 data input과 output, clock 신호사이의 관계를 보여준다.
.Q는 CLK negative edge 후의 D입력과 같다. Q-not은 D와 Q의 보수이다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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상태 유지
. 인에이블 입력이 1이면 디코더의 입력값에 따라 버퍼 중 하나가 동작
. n비트의 4개의 레지스터에 대한 공통 버스의 구성은
위 그림과 같은 회로가 n개 필요 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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and CMOS Dynamic Characteristics
EXERCISE OBJECTIVE
TTL과 CMOS gate의 transition time과 propagation delay를 결정한다.
DISCUSSION
·transition time은 10%에서 90%까지 움직이기 위한 digital 신호가 요구되는 시 간이다.
·propagation time은 입력이 50%, 출력이 50% 교차되었을 때 사
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.
NOR gate의 출력은 어떤 입력이 high일 때 low이다.
high input은 OR 또는 NOR gate에서 불가능할 것이다.
low input은 OR 또는 NOR gate에서 가능할 것이다.
OR/NOR gate 출력은 서로 보완적이다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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, 그리고 나서 되돌아온다면 negative clock transition과 original logic state사이에서 output은 변하지 않는다.
. PR 또는 CLR input이 logic 0일 때 output은 set 또는 reset 상태에서 유지 된다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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시작된다.
·CPU는 R/W 신호를 사용하는 변환의 방향을 선택한다.
·CPU는 데이터가 안정적으로 될 때까지 기다린다.
·데이터 변환은 CS신호의 falling edge에서 흔히 일어난다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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