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적분기(integrator)
그림 3-3은 적분기회로를 나타내고 있다.
그림 3-3 적분기회로
적분기는 미분기에서 저항과 커패시터를 바꾸어 놓은 형태의 일종의 반전증폭기로 반전증폭기의 이득공식을 그대로 적용시키면
(3-7)
은 적분연산자로서로 표현
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때문이다. 반면에 20kHz에서는 제대로 된 적분값이 출력되는 것을 볼 수 있다. 이렇게 주파수에 따라 출력이 다르게 되는 이유는 회로가 차단주파수 이하에서는 증폭회로로 동작하고 차단주파수 이상에서 적분기로 동작하기 때문이다.
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회로는 op amp를 이용하여 만든 적분기 회로이다. 위의 회로에서 전류는 입력 전압 v_i (t)을 저항 R으로 나누어 나타낸다. + 단자의 전압값이 0V이기 때문에 Op amp의 ? 입력 단자는 0V이다. 따라서 출력 전압은 수식 2와 같이 입력 전압의 적분에 상
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전자회로실험
-chapter24. 미분기 (예비보고서)
-chapter25. 적분기 (예비보고서)
미분기
1. 회 로 도
2. 결 과
조건 1
주파수
1KHz
C
조건 2
주파수
1KHz
C
조건 3
주파수
1KHz
C
조건 4
주파수
2KHz
C
3. 이 론
▶연산증폭기를 사용한 미분기의 간단한 회로-이상
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회로가 작동하는데 결과를 만족시키지 못하기 때문에 위와같은 결과를 얻었다고 생각한다. 1. 실험 및 실험결과
1) 도면을 참조하여 회로를 구성하라.
2) 적분기 실험을 통해 다음 표를 작성하라.
3) 미분기 실험을 통해 다음 표를
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적분기
- square-wave 1.0 kHz
Step 1 : 오실로스코프를 다음과 같이 설정한다.
Channel 1: 0.5 volt/division, Channel 2: 2.0 volt/division
Time base 0.5 msec/division
DC coupling
Step 2 : 회로를 결선하고, 브레드보드에 전원을 연결한다.
Step 3 : 함수발생기를 이용하여 입력
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적분기
회로도 도면
실제 제작한 회로도
실험에 들어가기에 앞서 실험에 필요한 준비도구가 필요하다.
- 브레드보드, 프로토보드, 멀티 미터, 캐패시터, 저항(10.100kΩ), OP AMP, ELVIS프로그램, 기타 전선들 실험 준비도구가 모두 확인되면 본격적
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: 2.06 [V] 출력신호 진폭 : 6.40 [V]
|그림 19-11| 삼각파 입력에 대한 미분기 출력 파형
입력신호 진폭 : 1.97 [V] 출력신호 진폭 : 10.7 [V]
|그림 19-12| 사인파 입력에 대한 적분기 출력 파형
입력신호 진폭 : 2 [V] 출력신호 진폭 : 15.7 [V]
|그림 19-13| 구형파
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회로는 높은 주파수를 강화하는 현상을 가지고 있다. 이 성질은 회로에 쉽게 유도되는 높은 주파수의 잡음 신호를 강화하므로 사용을 기피하게 된다. 따라서 극히 제한된 응용을 제외하고는 사용되지 않는다.
2) 적분기
⇒ 그림 3-1 의 미분기
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1. 적분기
①10KHZ
<회로도>
<시뮬레이션>
v0=1.455Vp-p
②4KHZ
<회로도>
<시뮬레이션>
v0=3.237Vp-p
③100HZ
<회로도>
<시뮬레이션>
v0=10p-p
2. 미분기
①10KHZ
<회로도>
<시뮬레이션>
v0=35mV
②1KHZ
<회로도>
<시뮬레이션&g
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