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철심은 자기포화가 되지 않아 기전력 는 여자전류에 비례해서 증가하므로 단락곡선은 직선성으로 됨을 실험적으로 확인가능했다.
5.3 직류시험
실험목적
직류시험방법을 익히고 직류시험을 통해 전기자전류(선전류)와 전기자전압(상전압)
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설계실습 또한 계획서에서 얻었던 결과 파형(아래서부터 Q1, Q2, Q3, Q4 순서이다)과 동일한
결과가 잘 나왔음을 확인해 볼 수 있다.
2. 결론
2007
앞에서 언급한 것처럼 이번 실험은 설계실습 계획서에서 예상했던 결과가 아주 잘 나왔다. 물론 회
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실험을 끝냈을 때에 다른 많은 조들이 어려움을 겪고 있었던 것을 본다면, 아주 쉬운 실험은 아니었다고 생각한다. 이로인한 상대적인 승리감이 이번 실험에서 조금 더 뿌듯함을 안겨 준 것 같다.
(4)무엇을 느꼈는가? 또 이 설계실습을 통하여
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설계사양에 따라 설계실습계획서에서 설계한 회로가 실제 구현되었을 때에도 설계사양을 만족하는가?
그렇지 않았다면 그 이유를 분석하라.
전제적으로 설계실습에서 설계한 회로대로 잘 동작하였다. 특별한 계산을 요하는 실험이 아니었
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case 1인 경우의 것이고 두 번째 waveform과 네 번째 waveform은 case 2인 경우의 것이다. < 제 목 >
< 목 표 >
< 설계조건 >
1. FSM state diagram
2. 엘리베이터 동작 설명
3. verilog 코드 & 주석
4. verilog 설명
5. waveform + 설명
6. 결과 및 토의
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실험 4.3의 회로를 그리고 자신이 설계한 회로와 차이가 있다면 그 차이를 분석하라. 측정값과 설계값을 비교하고 오차를 %로 표시하라. 오차의 원인을 분석하라.
→ b-c사이의 병렬저항은
=2.7kΩ
즉 b-c사이의 전압은
15×=9V
위 회로에 걸리는 저
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실험목적
브리지 정류 회로에서의 R부하에서 커패시터를 추가했을 때 C와 R을 변화시키면서커패시터의 효과를 알아본 후 각각을 비교분석한다.
(1) 브리지 정류기에서 입력전압 60V, R=60Ω, C=235μF 일 때 입력전압과 입력전류, 출력전압을 측정하
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설계실습 5. 신호 발생기
(1) 계획서의 (1)에서 설계한 대로, 그림 1에 주어진 Wien bridge 발진기를 제작하시오. 이 때OP-Amp는 ±15 V 전압을 공급하시오.
- R1=9.945kΩ, R2=20.1kΩ 으로 제작하였습니다.
(2) 입력파형과 출력파형이 Oscilloscope에 동시에
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4. 실험내용 및 절차.
그림 1 CS 증폭기
그림 2 CS 증폭기의 파형
- 위의 시뮬레이션은 조교님이 칠판에 주신 값을 토대로 Pspice를 돌려본 결과값입니다.
- 다음 사진은 (2)와 (3)에 대한 사진입니다.
그림과 같이 왼쪽 사진은 Bypass Capacitor가 있
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설계실습 3. Switching Mode Power Supply (SMPS)
(1) PWM 제어 회로.
Pulse Width Modulation 이란 위의 그림과 같이 어떤 임의의 아날로그 파형(그림에서는 사인파)을 톱니파형을 통해서 아래의 0과 1로 이루어진 디지털 파형으로 바꾸는 것을 뜻한다.
- 위의
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