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BJT와 같이 접합 전계효과 트랜지스터(JFET)은 차단, 포화, 선형의 세 가지 영역에서 동작한다. JFET의 물리적 특성과 JFET에 연결된 외부회로가 동작 영역을 결정한다. 이 실험에서는 JFET의 주어진 회로 규격들에 부합하여 선형 영역에서 동작하도
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물리적 주소와 논리적 주소 등을 모두 다루어야 하며 가장 근원적인 주소인 물리적 주소로부터 가장 사용자 친화적인 논리적 주소까지의 관계를 기술하여야 합니다.
2. 아래 각 용어들에 대하여 약자를 풀어 쓰시오.
(1) TCP/IP
(2) FTTH
(3)
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물리적 주소와 논리적 주소 등을 모두 다루어야 하며, 가장 근원적인 주소인 물리적 주소로부터 가장 사용자 친화적인 논리적 주소까지의 관계를 기술하여야 합니다.
2. 아래 각 용어들에 대하여 약자를 풀어 쓰시오.
(1) TCP/IP
(2) FTTH
(3)
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회로인 미분기와 적분기에 대하여 차후 실험을 통하여 이의 원리를 보다 자세히 알고 싶다. 1. 목 적
2. 이 론
A. R-C 회로
B. R-C 회로의 충전
C. R-C 회로의 방전
3. 실험 방법
A. 충전과 방전
B. 시상수
4. 실험 결과
A. 충전과 방전
B. RC
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하였는데 이 때문에 시간이 많이 소비되었다. 그리고 실험책이 없어서 임피던스를 구하려하여서 엑셀 식을 만들어 내는 과정에서 많이 시간이 소모 되었으나 실제로는 필요로 하지 않는 값이 여서 마음이 아팠다.
값의 오차가 심한 실험이였
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RC이론값
입력전압
입력전압0.632
걸린 시간
오차
(%)
충전
방전
100Ω
330 μF
0.033
5
3.2
0.0334
0.0334
0.04
충전
방전
1
2
3
4
5
6
6. 실험 분석 및 토의
전기 회로에 전압을 가하게 되면 전류는 점점 증가하여 정상치라는 일정한 값에 이르게 된다. 이 정상치
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실험결과 값 계산시 소수 둘 쨋자리에서 반올림함으로써 그 뒤의 많은 수를 생략해버렸다.
4. 고 찰
이번 실험은 RC 대역통과필터와 차단필터에 대해 알아보는 것이었다. 회로를 구성하고 실험을 하는 데 주파수를 변화시켜야 하는 것이 많았
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회로도 및 결과
JK Flip-Flop 실험
실험1) 다음 회로도를 구성하고, 표를 완성하시오.
실험1 회로도
실험1 시뮬레이션
실험2) 다음 회로도를 구성하고, 표를 완성하시오.
실험2 회로도
실험2 시뮬레이션
실험3) 다음 회로도를 구성하고, 표를 완성
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RC이론값
입력전압
입력전압*0.632
걸린 시간
오차
(%)
10kΩ
330μF
3.3
1.5V
0.948
3.26
1.21%
8. R = 100 kΩ 이고 C = 330 μF 일 때
저항
capacitance
RC이론값
입력전압
입력전압*0.632
걸린 시간
오차
(%)
100kΩ
330μF
33
1.5V
0.948
3.26
1.21%
5. 분석
이번 실험은 저항 R과,
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Fundamental of Physics, RLC 회로 부분 5.실험결과
A. 축전기의 정전용량 측정
B. 인덕턴스 측정 (10000Hz, 20000Hz 모두 실험하였으나 20000Hz에 대한 것으로 실험 결과 씀)
6. 실험분석 및 토의
7. 생각해 볼 사항
8. Reference
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