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MAX_plus와 FPGA를 이용한 이번 실험에서 실제 chip을 사용한 실험과의 차이점에 대해 기술하시오.( output data )
2. Altera MAX_plus와 FPGA를 이용한 실험에 앞으로 계속될 것이다. 다음의 실험을 위해서 각별히 주의 점검해야할 사항은 무엇이며, 실험을
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MAX-PLUS2를 이용하여 회로 구성 및 시뮬레이션값 확인.
MAX-PLUS2 를 이용한 회로구성은 인터넷과 책을 이용하여 설치부터 구성까지 손쉽게 할수 있었다. 회로구성은 SOP를 이용하면 되는데 여기서 중요한점은 실험실에서 주어지는 gate(AND, OR)는 2-i
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MAX+PLUS II의 VHDL을 활용한 주차 빌딩 관리 시스템으로
한백전자의 EMPOS COMBO 보드에 올려 테스트까지 완료한 프로그램입니다.
이 프로젝트는 디지털시스템설계 과목에서 자유주제로 한학기간의 프로젝트를 수행하면서 만든 작품입니다.
PPT
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ALTERA MAX+PLUS Ⅱ를 사용한 디지털 시계
LCD와 7세그먼트로 시간을 표현
스탑워치와 알람기능포함
도트메트릭스로 시간을 표현
핀설정은 다 되어있음
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Design Automation
컴퓨터 기술의 발달
처리 속도, 저장 용량, GUI의 성능 향상
집적회로 설계 기술의 발달
설계 기술의 축적, 설계 도구의 발달
설계자의 작업 및 결정을 대신하고 검증을 지원.
Definition of VHDL
VHDL is an international IEEE standard
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하드웨어기술언어의 이해 - 학습목표
-교육목표, 교과과정 및 내용을 소개함으로써 교육에 대한 의도와 필요성을 전달.
임베디드 시스템에 있어서 하드웨어의 의미와 하드웨어기술언어 중의 대표적인 VHDL의 위치와 역할을 소개.
기본적인
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MAX+plus 의 Text Editor를 사용하여 프로그래밍 하는 모습입니다. 실제 compile
은 MAX+plus에서 진행 하였습니다.
Appendix
1. A Figure of *.Gdf file with MAX+plus II +View List
Appendix
2. Rough Code with VHDL +View List
다음장은 사용한 VHDL 전체 코드입니다. Model Sim 의 Simul
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것이었다.
직접 브레드보드에 회로를 구성해 측정하는 것은 늘 오차가 발생하고 실험결과 값에 확신도 없었는데 max-plus2 는 회로 구성도 소자를 쉽게 개수대로 불러와서 쉽게 오차의 유무도 알려주고 결과도 잘 내주었다. 앞으로 예비 실험을
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max-plus2 를 가지고 회로를 구성하여 시뮬레이션을 해보았었다. 웨이브폼에서 파형의 결과가 겹치기도 하였지만 4상클럭 출력 파형들의 특성은 충분히 알 수 있었다. 그것을 보아가며 실험을 하니 실험이 틀렸는지 맞는지도 알 수 있어서 편했
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Max+Plus II를 사용하여 그림 6의 회로를 설계하고, 이 회로
에 대한 시뮬레이션 결과를 첨부하라.
그림 6 반가산기를 이용한 저가산기의 논리회로도
그림 6 시뮬레이션 결과
4-비트 이진 가산기 7483 IC
4-비트 2진 가산기인 7483 IC는 4 개의 전가산기
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