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입 력
출 력
A
B
C
D
Z
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5
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0
5
5
5
5
0
<표 2-9> 부울(Boolean)대수와 논리회로의 간소화
◉ 예비 문제
◈ 실험절차
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1. 실험 제목
2. 실험 목적
3. 실험 기구 :
4. 실험 방법
5. 관련 이론
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○ 설계방법이 어려운 반면에 정확하다.
○ 순차논리회로를 이용하여 설계.
5.Simulation
<실험1>
<실험2>
<실험3>
References
www.alldatasheet.co.kr
pspice 기초와 활용
네이버 블로그 1.Title
2.Name
3.Abstract
4.Background
5.Simulation
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회로가
안정된 동작을 하기 위해서 이같은 것을 만들었다.
1-2-1 8번핀을 GND로 묶으면 5번핀에 출력이 발생하지 않는다.
1-2-2
D[%]
0%
10%
20%
30%
40%
50%
(72%)MAX
V[V]
1.3k
1.8k
2.7k
3.25k
3.94k
5.33k
9.9k
V=2번핀 전압=2.4V ,, f==0.08uF
D=*100%=28% ,, =3.6s
f=0.08F ,, T=12.5s
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주파수를 측정하여 기록하라.
(t)를 정현파로 바꾸고, 위의 실험과정 , 를 반복하라.
구형파
정현파
진폭
주파수
진폭
주파수
(t)
(t)
<시뮬레이션 결과> 11.1 실험 주제
11.2 실험 장비
11.3 실험을 위한 기초 이론
11.4 실험방법 및 결과
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보고서의 도표 1에 관찰된 파형을 스케치하라.
4. 이 실험순서에서는 OR 게이트와 XOR 게이트의 조합을 사용하는 회로를 테스트하고 이 회로에 대한 진리표를 완성해 본다. 이 회로의 목적은 XOR 게이트의 선택적 반전 기능을 이용하여 4비트 2진
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회로
RC회로에서 R과 C의 위치만 바꾸어 highpass filter 기능을 갖는 CR회로를 구성한다.
RC회로 실험의 2~5과정을 반복한다.
☞실험 결과
⑴RC회로의 경우
R = 2.2 k C = 12 X 10 pF V = 1 v
①f=20kHZ
②f=180kHZ
③f=400kHZ
④ Bode diagram Bode diagram
⑵CR회로의 경우
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회로를 구성하라. Time Domain Analysis 에 의해 R3 에 흐르는 전류와 U1B 의 출력 전압을 구하여 별도의 그래프로 그려라. R3 가 ±5% 범위에서 변할 때, U1B 의 출력 전압의 변화를 구하라.
- 이전 실험에서 저항 R9에서 1mA 의 전류가 흐르고, 이 전류가 그
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논리곱과 동일한 결과를 출력하는 소자. 실험2. 게이트와 부울대수 및 조합논리 회로
AND - Gate
OR - Gate
NOT - Gate
NAND - Gate
NOR - Gate
Exclusive-OR - Gate
Bool 대수란?
Bool 대수의 표기법과 그 예
Karnaugh Map
실험 Pspice 회로도
실험 Pspice 결과
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출력(Y)
(V)
A(V)
B(V)
0
0
0
5
0
5
0
5
5
0
5
0
5
5
5
0
5. 기초실험 (2)의 실험결과에 대한 타이밍도를 그리시오.
A
B
C
X
6. 다음 OR 게이트 회로의 논리식을 쓰시오.
X = ((A+B)+C)+D
Y = (A+B)+(C+D)
7. 다음 AND 게이트 회로의 논리식을 쓰시오.
X = ((AB)C)D
Y = (AB)(CD)
8. 본
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