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실험에서는 회로가 워낙 복잡해서 결과가 잘 나오지 않아서, 동작표를 위에 정리하였다.
- 업다운카운터는 양방향카운터로 카운터입력에 신호를 물린 후 여러곳에 사용될 수 있다.
ⅲ. 예비과제에서 구한 10진 리플 카운터를 구성하고, 그 출
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예비보고서의 시뮬레이션과 결과값 비교
<시뮬레이션> <시간에 따른 전류파형>
<시뮬레이션> <시간에 따른 전압파형> 예비보고서
1. 실험의 목적
2. 실험을 위한 기초 이론
3. 실험방법
4. P-spice 시뮬레이션
결과보고
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OR한 다음 부정한 것은 두 신호를 각각 부정한 다음 AND한 것과 같다"는 것을 알 수 있다. 위의 항등식을 다음 진리표를 이용하여 증명해 본다 1. 실험목적
2. 실험이론
(1)NAND 게이트의 변환
(2) NOB 게이트의 변환
3. 실험방법
예비고찰
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다른 회로의 전가산기를 구성하라. ●실험 목적
●실험 원리
○ 반가산기 (Half-Adder, HA)
○ 전가산기 (Full-Adder, FA)
○ 반감산기 (half subtracter , HS)
○ 전감산기 (full subtractor , FS)
● 결과보고서
○ 비고 및 고찰
○ 문제
○ 고찰
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결과
반가산기
전가산기
Reference
1. 디지털논리시스템(동명사)-정의봉 저.
2. 디지털공학실험(복두출판사)-김상욱외 7명
3. Didital Logic Application And Design, Yarbrough 실험9. PLD를 이용한 회로구성
관련이론
○ PLD란?
○ PLA
○ PAL
실험계
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3 분배법칙
a) (A+B)(A+C)=A+BC
b) AB+AC=A(B+C)
정리 4 a) A0=0
b) A+0=A
정리 5 a) A1=A
b) A+1=1
정리 6 a)
b)
정리 7 a) AA=A
b) A+A=A
정리 8 a) A(A+B)=A
b) A+AB=A
정리 9 학 습 지 도 안
◎ 디지털 논리회로
Ⅰ. 기본 논리 게이트(Logic Gate)
Ⅱ. 부울대수(Boolean Algebra)
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기본 논리 회로
◈ 논리곱(AND)회로
◈ 논리합(OR)회로
◈ 논리 부정 회로(NOT gate)
◈ 버퍼회로
◈ 논리곱 부정(NAND)회로
◈ 논리합 부정(NOR) 회로
◈ 배타적 논리합(XOR)회로
◈ 배타적 NOR(XNOR) 회로
♣ 드 모르간의 정리
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De-Morgan 의 정리라 하며, 이 두 식은 NAND 게이트 와 NOR 게이트의 응용 및 논리회로를 간소화시키는데 널리 이용될 수 있다.
2.1 NAND 게이트를 이용한 기본논리회로
[ 실 험 ] 1. 목적
2. 기본이론
- 불승산
- 불가산
- not 기능
3. 실험
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결과 값이 출력된다. · 진리표A
B
D0
D1
D2
D3
0
0
1
0
0
0
0
1
0
1
0
0
1
0
0
0
1
0
1
1
0
0
0
1
실험 2. PSpice나 Quartus II를 이용해 시뮬레이션을 위한 회로 구성에 힘든 점이 있어 진리표로 시뮬레이션 값 대체함. 1. 실험 이론
2. 문제
3. 실험 방법
4. 시뮬
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카르노 맵을 사용해서 간소화 하는 것이 더 편하다. 카르노 맵
4-2 카르노 맵
4-2-1. 2변수 카르노 맵
4-2-2. 3변수 카르노 맵
4-2-3. 4변수 카르노 맵
4-3 간소화
4-3-1. 묶기와 간소화.
<정리>
Lab. 8 카르노 맵을 이용한 간소화 실험결과
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