|
논리게이트와 부울대수 3.1 논리연산과 논리게이트 3.2 부울대수 3.3 부울함수의 정규형 및 표준형 제4장 부울함수의 간소화 및 구현 4.1 개요 4.2 카노우 도표 방법 4.3 NAND 게이트와 NOR 게이트를 이용한 구현방법 제5장 조합논리회로 5.1 개요 5.2
|
|
|
.
논리회로의 배열에 따라 아주 다양한 논리연산이 가능하다는 것도 Boolean equation을 쓰면서 이해하게 되었고, 조그만 변화도 완전 정반대가 되는 연산을 낳을 수 있다는 점도 알게 되었다. I. 목적
II. 실 험 결 과 분 석
III. 토의와 토론
|
|
|
논리연산
(1) AND연산
(2) OR연산
(3) NOT연산
나. 논리 게이트
(1). AND 게이트(논리곱)
(2). OR 게이트(논리합)
(3). NOT 게이트(논리 부정)
(4). NAND 게이트
(6). EXCLUSIVE-OR 게이트
자. 드모르간의 법칙
차. 부울대수
3
|
|
|
논리회로도 등가라는 사실을 기억하라.
■ 실험순서
▶ 논리 연산
1. 부록 A에서 7400 quad 2-입력 NAND 게이트와 7402 quad 2-입력 NOR 게이트의 연결 다이어그램을 찾아보라. 이들 IC 각각에는 4개의 게이트들이 포함되어 있다. Vcc와 접지를 해당 핀에
|
|
|
반가산기 : 2진수 덧셈에서 두 개의 비트 A와 B를 더한 합 S와 자리올림(carry) C0를 출력하는 조합회로이다.
전가산기 : 두 개의 비트 A, B와 밑자리로부터의 자리올림 C1을 더한 합 S와 윗자리로의 자리올림 C0를 출력하는 조합회로이다. 가산
|
|
|
연산회로
▷ 2진 가산기의 출력
D = A + Y + Cin
▷ 회로의 동작결과는 <표 4-4>에 보여진다
논리 마이크로 연산
◎ 논리 마이크로연산
- 레지스터에 저장된 비트열에 대한 2진 연산으로서 각 비트를 독립된 2진 변수로 가정하여 연산을 수행
|
|
|
연산
4-3-1 래치(latch)와 플립플롭(flip-flop)
(1) 비동기식 S-R 래치(latch)
(2) 동기식 S-R 래치와 S-R 풀리풀롭
(3) D 래치와 D 풀리풀롭
(4) J-K 풀리풀롭
(5) T 풀리풀롭
4-3-2 레지스터와 카운터
(1) 레지스터(register)
(2) 카운터(counter)
|
|
|
논리회로를 구성하여 실험을 통하여 진리표를 작성하라.
6. 실험 내용 및 결과
(1) 인버터 게이트의 회로를 구성하고 0V와 5V의 값을 가진 1kHz 구형파를 Vi에 연결한다. 입력전압 Vi와 출력전압 Vo를 각각 Ch1과 Ch2에 연결하고 DC coulping mode에서 파형
|
|
|
회로 모양이다. 따라서 클럭 펄스가 들어올때마다 출력이 바뀌게 되며, 이 관계가 그림 5(c)의 진리표에 표기되어 있다. 또 T플립플롭의 표시기호는 그림 5(b)와 같고 이때 T는 클럭펄스를 나타낸다.
T
Qn+1
0
1
Qn
Qn
(a) 회 로 (b) 표시기호 (c) 진리표
|
|
|
논리 설계(logic design)단계, 시스템 설계(system design) 단계, 실제적 설계(physical design) 단계로 나뉜다.
(1) 회로 설계 단계는 논리연산을 행하는 논리회로의 기본소자인 논리소자를 만들기 위해 능동소자와 저항과 같은 수동소자를 연결하는 단계
|
|
메뉴펼치기
