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실험한 내용은 ring counter로 하나의 신호가 계속 출력단자를 순회하는 counter
실험이다. 바로 앞의 실험에서와 같은 내용이라 실험하는데 큰 무리는 없었다.
※ Ring Counter를 실험하면서 생각하였는데, 이 카운터는 논리회로에서 배운 내용인 1-out
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실험 1(a)과 (b)에서, Y는 A와 같고 Y 열에는 A가 들어간다. 실험 2(a)와 2(c)에서 Y는 항상 1과 같다. Y 열에는 1이 들어간다.
(b) 실험에 의해 증명된 표 2-13의 각 행의 입력 A와 출력 B사이의 관계를 부울식으로 표현하시오. 이 식은 논리 다이어그램
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실험 고찰
1. MUX와 DEMUX의 응용분야에 대해 실제 예를 들어가면 기술하시오.
2. 81 MUX와 26 DEMUX를 설계하고, 설계한 회로도의 논리도를 완성하시오.
6. 필요한 결과
표 11-1
Y
1
0
0
0
0
0
0
0
1
0
1
0
0
0
1
0
1
1
0
0
0
1
0
0
1
1
1
0
0
1
1
0
1
표 11-2
Y
0
0
0
1
1
0
1
1
0
0
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실험에서 핀 14(입력)와 핀 12(출력)사이의 2분주기, 그리고 핀 8과 9에서 중간 출력을 갖고, 핀 1을 입력, 핀 11을 출력으로 하는 5 분주기 회로로 구성되어 있다. 이에 대해 다음 논리도를 참조하시오.
실험 방법
CLK에 79번 pin을 assign하고 output은
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실험값)
SC
SE
0
0
0
0
1
1
1
1
1
0
1
1
0
1
1
0
5. 4비트 2진 전가산기와 그의 보수를 이용한 4비트 2진 전감산기
IC 7483은 MSI 4비트 2진 전가산기이다.
다음 회로의 합 또는 차의 출력은 FPGA의 LED로 출력핀을 설정하여 FPGA의 LED로 출력을 확인한다.
그림 8-6
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