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실험을 마쳐야 할 경우에는 실험A와 B 중 하나만 하는 것이 좋다.
Ⅴ. 실험결과
실험 A. 의 합성
의 질량 : 0.15g
요소의 질량 : 0.5g
아세틸아세톤의 부피 : 0.5mL
초록색을 띤 가 들어간 반응 물질이 열 중탕을 가하자 서서히 보라색을 띠었다. 약 30
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된다. ⑤ 공진 주파수 : ⑥ 공진 곡선 : 공진회로에서 주파수에 대한 전류변화를 나타낸 곡선. ⑦ 선택도 : 회로에서 원하는 주파수와 원하지 않는 주파수를 분리하는 것. 1. 실험제목: RLC 직렬 교류 회로
2. 실험목적:
3. 실험이론:
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실험
1. 그림 4와 5에서와 같이 트랙을 배열한다. 만곡의 정점에 포토게이트를 장착한다. 또한 트랙의 끝부분에 제동장치(catcher)를 장착하여 자동차가 트랙의 끝부분에서 이탈하지 않도록 해준다.
2. 만곡의 중앙에 못을 꽂는다. 미니 자동차를
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회로에 의해 -20dB/decade가 부가되어 -40dB/decade의 롤-오프로 감소 시작
- fc(bypass)까지 계속 감소하면, 이점에서 바이패스 RC 회로에 의해 -20dB/decade가 또 다시 부가되어 -60dB/decade의 롤-오프로 감소 시작
Chapter2. 실험 결과 (시뮬레이션)
PSpise 모의실
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표지 양식
년도-학기
2020 년 2학기
과목명
전자회로실험
LAB번호
제목
1
연산 증폭기 및 선형 연산
증폭기 회로
실험 일자
2020년 11 월 25 일
제출자 이름
제출자 학번
Chapter 1. 관련 이론
연산증폭기
연산 증폭기(op-amp, Operational amplifier)는 한 개의
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경우의 드레인 포화전류는 라고 표시하며, , ,의 사이에서
의 관계가 성립된다. FET의 3정수인 증폭정수 μ, 드레인저항 , 상호컨덕턴스 은 다음과 같이 정의 된다.
Common Source의 경우에 대해서만 실험하며 CS에 대한 회로를 보면
<그림1. 소스공
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회로를 저항 RTh와 전압원 VTh의 직렬 연결된 등가회로로 바꿀 수 있음을 의미한다. 여기서 VTh는 단자 ab의 개방회로의 전압이고는 RTh는 독립 전원은 단락, 독립 전류원은 개방시 단자 ab에서 들여다 본 전체 저항을 말하는 것이다.
Chapter2. 실험
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회로와는 다른 회로가 있을수 있다. 자주 발생하는 한 가지 문제는 인덕터 저항을 고려할 필요가 있다는 사실이다. 인덕터는 통상적으로 와이어의 코일로 구성되어있는데, 이때 발생되는 저항은 일반적으로 바람직한 것은 아니지만, 종종 회
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실험 결과 (시뮬레이션)
PSpice 모의실험 - CH.4 소신호 공통 이미터 증폭기
PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라. 또한, 회로의 schematic 및 입력전압(vin), 출력전압(vout)의 파형을 해당 표에 포함하여 시뮬레이션
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표지 양식
년도-학기
2020 년 2학기
과목명
전자회로실험
LAB번호
제목
1
차동 증폭기 회로
실험 일자
2020년 11 월 18 일
제출자 이름
제출자 학번
Chapter 1. 관련 이론
차동 증폭기(differential amplifier)
아날로그 집적회로(IC: integrated circuit)를 구성하는
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