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실험값에 오차를 생기게 만든다.
▶▶ 중첩의 원리
④ 표 1-13로부터 중첩의 원리가 성립됨을 보여라.
중첩의 원리에 의하면 I1 = I1' - I1'' , I2 = I2' - I2'' , I3 = I3' + I3'' 이 성립해야한다.
표 1-13
지로 전류
이론치 [mA]
측정치 [mA]
I1
5.540 mA
6 mA
I2
1.328
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실험 6 OP - AMP 실험
◎ 결과 보고서
2. 2) 1. 5hz 1khz
10khz 100khz
2. 2) 2. OP - AMP 출력이 느려서 스위칭할 때 딜레이가 생긴다.
100hz 1khz
10khz 100khz
2. 3) V는 과도한 전류를 뽑을 수 없다. 저항의 병렬연결로 peat to peak가 낮아진다.
3. 2) V=(+V) ,, V=(-V)
이론치
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실험 결과
실험 3-1 : LC 공진 회로
▣ LC직렬 공진회로에서 공진 주파수 구하기
1. LC 직렬 회로의 임피던스를 측정하기 위하여 L=1mH , C = 0.33㎌ , Rm = 100Ω으로 회로 3-1을
구성한다. 회로 구성에 앞서 저항계를 써서 100Ω 저항의 저항값을 측정하여
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기초전기전자공학실험
→ 곽경섭외 (주)교학사
디지털회로실험
→ 배명진외 에드텍 멀티미터의 사용법
Ⅰ. 실험목적
Ⅱ. 관계이론
Ⅲ. 실험방법 (일반멀티미터)
Ⅲ. 실험방법 (디지털멀티미터)
Ⅳ. 예상실험결과
Ⅴ. 참고문헌
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측정하였을 때 나올수 있는 저항의 크기의 다름폭을 %로 표시한 것이다.
Ⅴ. 참고문헌
http://hanbat.ac.kr/~bee/om.htm
기초전기전자공학실험 곽경섭외 (주)교학사 Ⅰ. 목적
Ⅱ. 관계이론
Ⅲ. 실험방법
Ⅳ. 예상실험결과
Ⅴ. 참고문헌
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실험 1>
<실험 2>회로 구성 및 입·출력 값.
고찰
이번 시뮬레이션은 <실험1>의 회로를 수정하여 ring counter를 구성한 시뮬레이션이다. ring counter에서 1자리는 1상태이고, 나머지 모든 자리는 0 상태로 되고 트리거에 따라 1 상태는 다음
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실험이기 때문에 PRESET과 CLEAR 값이 없을 때 enable이 이론에 맞게 동작되었음을 알 수 있다.
4) 다음 회로를 구성하고 PRESET, CLEAR와 enable를 변화시켜 가며 출력을 관찰하여 기록하라.
5) 다음 회로를 구성하고 진리치표를 완성하라.회로 구성 및 출
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실험 5에서 PRESET과 CLEAR는 각각 어떤 역할을 하는가? - 원래 PRESET은 출력을 1로 CLEAR는 출력을 0으로 만들어주지만 우리는 반전회로이므로 반대로 입력해주어야 하는 것이다. 그러므로 PRESET이 1이 입력된 구간에서는 입력이 주어진 구간에서만
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실험하는 과정에서도 굉장히 복잡한 회로가 구성되겠지만 실험 전에 미리 필요한 IC회로의 개수와 구성을 생각해두어 실험하는데 어려움을 줄일 것이다.
이번 설계에서는 SN7404, SN7408, SN7432 소자가 필요하다. 시뮬레이션을 위한 회로에서는 NO
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실험 1. NOT게이트와 AND게이트를 이용하여 디코더를 구성하여 값을 측정한 후 진리표를 작성하는 실험. 시뮬레이션 값을 분석해보면 00이란 값이 입력되면 D0에서 출력되는 것이고, 01값이 입력되면 D1, 10값이 입력되면 D2, 11값이 입력되면 D3이
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