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설계 황선영 교수님 강의 자료
McGraw-Hill, Fundamentals of Digital logice with VHDL design, Brown&Vranesic, 2/e
아진, 실습으로 배우는 VHDL, 이강/장경선, 증보판
http://asicfpga.com/site_upgrade/asicfpga/pds/dsp_pds_files/mul.ppt 1. 제목 : 고속 동작 곱셈기 설계
2. 목적
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곱셈기 설계를 통해 VHDL을 이용한 sequential circuit의 description 방법을 익히고 동작 확인 과정을 통해 simulation tool의 사용법을 익힌다.
3. 목표 및 기준 설정
(1) 목표 및 기준설정
shift and add 횟수 감소를 통해 고속 연산을 가능하게 하는 Booth’s
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알고리즘이 항상 제대로 동작하지 않는다. 특히 하나 또는 두 개의 오퍼랜드가 음수이면 제대로 동작하지 않는다.
이 알고리즘은 오직 양수만 취급하도록 설계되었기 때문이다.
그에 비해 Booth algorithm의 동작원리를 살펴보면 연속된 1이 0에
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알고리즘에 관한 연구, 국민대학교
배동윤(1997), 68000 CPU를 이용한 교육용 System 및 교재 개발, 충남대학교
송한정(2000), 전압제어형 카오스 집적회로의 설계에 관한 연구, 한양대학교
이현철(2004), 수동적 전기특성을 이용한 인체의 신호전달방
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알고리즘, 전력전자학회
5. 이현규(2011), 브러시리스 직류 전동기에 대한 고효율 제어기의 설계, 한밭대학교
6. 정연택 외 1명(1983), 자력식 복권 3상동기 발전기, 대한전기학회 Ⅰ. 개요
Ⅱ. 직류전동기(DC모터)의 개념
Ⅲ. 직류전동기(DC
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