|
회로의 연결을 잘못 했다거나 부품의 내부고장으로 유효하지 않은 상태를 나타낸다고 생각이 든다.
고찰
이번실험의 목적은 7404인버터를 사용한 간단한 논리 프로브를 구성하는 방법과
구성된 논리 프로브를 사용하여 회로를 테스트를 한뒤
|
|
|
실험 2. 논리회로의 간략화 결과 레포트
(a) NOT 게이트
PSPICE 시뮬레이션 결과
*실험결과*
A
Y
0
1
1
0
(b) AND 게이트
PSPICE 시뮬레이션 결과
*실험결과*
A
B
Y
0
0
0
0
1
0
1
0
0
1
1
1
(c) OR 게이트
PSPICE 시뮬레이션 결과
*실험결과*
A
B
Y
0
0
0
0
1
1
1
0
1
1
1
1
(d) NO
|
|
|
이용하여 비동기입력 프리세트와 클리어 입력을 갖는 SR 플립플롭을 설계하시오.
sol)
6.8 그림 6.12의 2번과 6번 게이트의 입력에 비동기 입력인 클리어 단자를 연결하시오.
sol)
6.9 두 클럭 전의 입력과 같은 출력을 갖는 동기 순서논리회로를 JK
|
|
|
회로
x = ab, y = c + d
F = ab(c+d)+c\'d\'(a\'+b\') = xy + x\'y\'
(b) 14개의 입력을 갖는 다단 논리회로
그림 2.2.3 회로 다단화
그림 2.2.4 기술 매핑
2.3 레이아웃 합성(Layout Synthesis)
자동 생성되거나 또는 물리적 Mask Pattern을 설계
(a)
(b)
그림 2.3.2 Floorplanning 과
|
|
|
논리도를 2 입력 NOR 게이트만을 이용하는 가장 간단한 회로로
F = B+(C(A+D\')) = (B+(C\'+(A+D\')\')\')\'\'
변환하시오.
2.7 2비트 데이터에 1비트를 MSB에 추가하여 홀수 패리티(odd parity)를 발생시키는 회로를 설계하려고 한다.
A(D1)
B(D0)
P
0
0
1
0
1
0
1
0
0
1
1
1
|
|
|
논리회로를 만들어 드모르간의 정리가 맞음을 확인하는 실험이라
결과 값이 예상이 쉬웠습니다. 하지만 지난번 실험들보다 회로자체가 좀 더 손이 많이 가고 예상했던 결과 값과 달리나와 회로에서 잘못된 점을 찾아내는데 시간이 오래 걸렸
|
|
|
2개 이상의 입력단자와 1개의 출력단자를 갖고, 입력단자 모두에 “1”의 신호를 가할 때에만 출력단자에 “1”의 신호가 나타나는 회로 수의 체계
부호의 코드화
기본 논리 회로
부울식의 간략화
조합 논리회로
순차 논리회로
설계
|
|
|
논리회로를 결선하여 A, B 입력에 따라 출력 X, Y를 측정하라.
(e)
(e)
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.29 ~ p.38
③ 디지털 시스템 / 송상훈 외7명 / 인터
|
|
|
회로가 열려서 전구에 불이 켜지지 않는다. 즉, 출력이 OFF 또는 0 의 상태가 된다.
참고문헌
김영훈(1992), 새로운 고속 및 저전력 논리 게이트 설계, 동국대학교
김성경 외 3명(2010), 새로운 패리티 보존형 가역 논리게이트, 대한전자공학회
김
|
|
|
실험을 통해 알아보았고, 앞으로 논리회로를 이용한 회로를 구성하는데 필수적인 기본 지식을 다지는 계기가 되었다.
4. 예비레포트의 가상 결선도
그림 1
그림 2
그림 3 ⒜
그림 3 ⒝
그림 4
그림 4⒝
그림 4⒞ 1. 실험 의의
2. 실험 수행 과
|
|
메뉴펼치기
