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전문지식 5,105건

설계하는 것. 이렇게 두가지 방법이 있었는데, 우리 조는 FPGA 킷을 이용하지 않는 쪽을 선택하였다. 한 학기 동안 논리회로 설계실험 과목을 수강하면서 생소했던 vhdl coding을 배우고, 매주 이론과 실습을 반복하면서, vhdl이라는 언어에 친숙해
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  • 등록일 2010.01.18
  • 파일종류 한글(hwp)
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설계하는 실험이었다. 지난 번 실험 때는 vhdl이라는 것이 너무나도 생소하였고, model sim이나 xilinx 프로그램을 태어나서 처음 접하였기에 많이 헤맸었다. 하지만 실험 내용을 집에서 연습해 보면서 어떤 방식으로 논리회로가 동작하는지 원리
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  • 등록일 2010.01.18
  • 파일종류 한글(hwp)
  • 참고문헌 없음
  • 최근 2주 판매 이력 없음
설계보다 코딩으로 기술 가능한 점, Simulation을 통해 오류를 찾기 쉬운점, 정확한 논리식이 불필요하고 알고리즘에 의해 구현가능한 점, 쉽게 수정 가능한 점을 이번 Term Project를 통해 느끼게 되었습니다. 1.개요 -VHDL언어란 2. Term Project주
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  • 등록일 2018.06.21
  • 파일종류 한글(hwp)
  • 참고문헌 없음
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f door_lock_mod_tb is component door_lock port ( clk : in std_logic; rst : in std_logic; ps_start : in std_logic; ps_end : in std_logic; ps_mod : in std_logic; ps_num : in std_logic_vector (3 downto 0); door_open : out std_logic; alarm : out std_logic ); end component; signal clk : std_logic; signa
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  • 등록일 2014.02.25
  • 파일종류 한글(hwp)
  • 참고문헌 없음
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f door_lock_mod_tb is component door_lock port ( clk : in std_logic; rst : in std_logic; ps_start : in std_logic; ps_end : in std_logic; ps_mod : in std_logic; ps_num : in std_logic_vector (3 downto 0); door_open : out std_logic; alarm : out std_logic ); end component; signal clk : std_logic; signa
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  • 등록일 2014.03.27
  • 파일종류 한글(hwp)
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논문 28건

설계하였다. <1> 전하펌프를 설계하는데 있어서는 위에 회로에서 구현하였던 회로를 구현하기에는 광범위한 회로가 요구됨으로 인하여 UP신호가 들어가는 곳에 PMOS로 들어가는 하나의 입력신호를 인가하였고 NMOS 쪽에는 DOWN신호를 인가하
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  • 발행일 2010.02.22
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  • 저자
작 시의 주의사항이었다. 회로제작은 설계사항에 따라 NE555 - 7490 - 7442 - LED 로 구성하여 NE555에서 구형파를 발생시켜 넣어주면 LED 다이오드가 순차적으로 발광되도록 하였다. 그리고 LED 다이오드가 ON되는 순차적인 속도는 9V의 입력을 받는 첫
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  • 발행일 2010.06.03
  • 파일종류 한글(hwp)
  • 발행기관
  • 저자
door_lock.vhd library ieee;  use ieee.std_logic_1164.all;  use ieee.std_logic_arith.all;  use ieee.std_logic_unsigned.all;   entity door_lock is port(   clk : in std_logic;     sw1,sw2 : in std_logic;     key1  : in std_logic;     clear : in std_logic;
  • 페이지 51페이지
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  • 발행일 2012.06.24
  • 파일종류 기타
  • 발행기관
  • 저자
yield tiny hairpin-line resonator filter", MW&RF November 1999 [5] 곽우영,박진우, “ Hairpin Line 여파기의 간단화된 등가회로”, 한국통신학회논문지 99-9 Vol.24 N0.9A Ⅰ. 서 론 Ⅱ. 설계 이론 Ⅲ. 설계 및 시뮬레이션 Ⅳ. 제작 및 측정 Ⅴ. 결 론
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  • 발행일 2008.11.18
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  • 저자
설계된 PLL 모듈의 규격은 표 4.1과 같다. 4.2.1 PLL 설계 표 4.1 PLL 모듈의 설계 규격 항목 단위 설계규격 주파수 대역 MHz 800 직류 공급전원 V 5 기준 주파수 MHz 7 스퓨리어스 dBc <-70 위상잡음 dBc/Hz @1kHz offset <-80 설계된 PLL회로의 특성을 미리 알
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  • 발행일 2008.03.04
  • 파일종류 한글(hwp)
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취업자료 444건

논리대결'에 참여하여 2연승을 차지하기도 하였습니다. 이런 저의 열정과 에너지를 대우조선해양에서 발산하고 앞서 말씀드린 저의 비전을 함께 성취하고 싶습니다. ㅇ사회생활과 연수경험 - 건설에 에세이 쓸때 참고 (한화건설) 아르바이트
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[프로그래밍및실습/A+] C 언어로 프로그래밍을 학습. [전자회로및설계(1)/A+] 전자의 전반적인 이해와 기본적인 회로를 설계 하였습니다. [공업수학/A+] 전기관련분야를 이해하기 위한 과정을 학습. [디지털공학/A+] 순서논리회로의 분석 및 설계
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  • 직종구분 전문직
. 5) 현대모비스에서 이루고 싶은 목표는 무엇인가요? 답변: 차세대 전력 변환 기술을 적용하여, EV 컨버터의 효율성과 신뢰성을 극대화하는 데 기여하고 싶습니다. 2025 현대모비스 EV용 컨버터 전력회로설계 자기소개서 자소서 면접
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  • 등록일 2025.03.27
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설계 단계에서부터 효율적인 아키텍처를 고려하고, 최적화된 회로 설계를 수행하는 것이 중요합니다. 2) RTL 설계 경험이 있습니까? 답변: 네, Verilog 및 VHDL을 활용한 RTL 설계 경험이 있으며, FPGA 프로젝트에서 FIR 필터 및 영상 처리 모듈을 설
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  • 등록일 2025.03.20
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회로 31 전기 시스템 보호 및 안전 32 신재생 에너지 시스템 32 전기동학 및 초기 전기공학 32 ? 전자공학 학위과정 지원자의 기본적인 학술적 능력을 검증하는 보충문제 33 전자기기 및 반도체 33 디지털 시스템 및 설계 34 아날로그 전
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  • 등록일 2024.09.14
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