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전자통신연구회 편, 『전자통신기초실험』, 도서출판 상학당, 2009, pp43-47.
네이버 백과, 검색어|등가회로, http://100.naver.com/100.nhn?docid=52029
네이버 지식인, 답변자|angelo83, 답변일자|2007.10.04, http://kin.naver.com/detail/detail.php?d1id=11&dir_id=110209&docid=46922
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회로에서 JFET 순방향 전달컨덕턴스가 증가하면 전압이득은 어떻게 변하는가?
(a) 증가한다. (b) 감소한다. (c) 변동이 없다.
⇒ 의 공식을 확인해 보면 gm의 증가에 따라 전압이득은 증가함을 확인할 수 있다.
4. 그림 23-1의 회로에서 부하저항 RL
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은 0V이다. 그리고 게이트-소스간 음전압의 크기는 1.265V인 반면 VGS(off)는 2.1V로 게이트-소스간 음전압의 크기가 VGS(off)에 비해서 작다.
2. 그림 21-1의 자기바이어스 회로에서 IDSS=10mA이고 gm0=5000㎲이면, 소스전류는 대략 얼마인가?
(a) 1mA(b) 2mA(c) 5
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회로에서 동상신호제거비가 100,000:1이고 첨두간 입력전압이 10V일 때, 첨두간 출력전압은 얼마인가?
(a) 0.001V(b) 0.01V
(c) 0.1V (d) 1V
⇒ 동상신호제거비가 100,000:1에서 입력전압이 10V이고 28-1의 동상전압이득은 10000으로 첨두간 출력전압은 1V임을 알
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컬렉터-이미터전압에 다 걸리는 것을 알 수 있다. 1. 실험목적
2. 배선(회로)도
3. 실험에 사용한 소요부품 및 장비
4. 데이터표
< 데이터-컬렉터귀환 바이어스 >
Data값에 대한 분석(결론)
Discussion
실험 12장에 대한 복습문제
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어느 순간에 전류가 갑자기 흐르는 항복현상을 현상을 확인 할 수 있었다.
제너 전압부근을 확인하였으며, 제너 전압부근에서 전류가 흐르는 현상을 확인 하였다. 1. 실험목적
2. 실험장비
3. 실험 이론
4. 실험순서 및 방법
5. 결과
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[ERROR : 10731] 오류 발생. 1. 실험목적
2. 실험장비
3. 실험 이론
4. 실험순서 및 방법
5. 결과
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500Ω (b) 750Ω (c) 1㏀ (d) 10㏀
⇒ 교류부하선의 중간에 동작점을 위치시키기 위해서는 rc=RC||RL의 공식과 rc=VCEQ/ICQ의 공식을 조합해서 구할 수 있었고 그 결과 rc=490.84Ω이 나왔으며, 490.84Ω=1kΩ||RL로 바꿔 써서 구해보면 RL=964.02Ω가 나오게 되므로
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스 공통 증폭기의 실제 실험 회로와 시뮬레이션 결과이다.
시뮬레이션에서는 Vin > Vout 으로 AV가 1보다 작은 결과가 도출되었는데, 결론부터 언급하자면 시뮬레이션의 오류이다. 실제 실험에서는 AV가 1 이상이 되도록 나왔고, 회로가 증폭기
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실험 24장에 대한 복습문제
1. 그림 24-1의 회로에 대한 중간대역 데시벨 이득은 대략 얼마인가?
(a) 9.5 dB (b) 19.5 dB
(c) 23.6 dB (d) 27.4 dB
⇒ (Av)=(RC||RL)/(r\'e+RE1)=(3.9kΩ||2.7kΩ)/(18.176Ω+150Ω)=9.531이고 이것을 데시벨 단위로 환산하면, Av(dB)=20×log9.531=19.583(d
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