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전문지식 272건

논리회로 실험, 생능출판사 이순흠 외 3명(2008), 웹기반 디지털 논리회로 가상실험실의 교육효과, 한국컴퓨터교육학회 오윤정(2005), 부울대수와 논리회로 학습을 위한 웹 코스웨어 설계 및 구현, 전남대학교 최수정(2004), 조합논리회로 학습을
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  • 등록일 2013.07.12
  • 파일종류 한글(hwp)
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조합논리회로의 출력은 오직 현재의 입력 신호에만 의존하며, 이전 상태나 과거의 입력과는 무관합니다. 이러한 특성으로 인해 조합논리회로는 신속하고 효율적인 처리를 가능하게 하며, 다양한 전자계산기 및 디지털 시스템에서 핵심적인
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  • 등록일 2024.12.28
  • 파일종류 워드(doc)
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변화 제 1장 컴퓨터와 디지털 논리회로 제 2장 데이터 표현 제 3장 논리 게이트와 부울 대수 제 4장 부울대수 간소화 및 구현 제 5장 조합 논리회로 제 6장 순서 논리회로 제 7장 레지스터와 카운터 제 8장 기억장치와 PLD
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  • 등록일 2014.08.31
  • 파일종류 피피티(ppt)
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저항을 앞에 달아주면 괜찮을 것 같았다. 다음실험에는 미리 회로구성과 핀번호같은 것을 충분히 숙지하고 실험에 임해야겠다. 디지털 공학 실험 6장 가산기와 ALU 그리고 조합논리회로 응용 결 과 보 고 서 1. 결과 2. 검토 및 고찰
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  • 등록일 2014.03.16
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회로이다. 디멀티플렉서는 멀티플렉서와 반대기능을 하는데, 하나의 입력선으로 정보를 받아서 여러 출력선으로 분배하는 기능을 한다. 멀티플렉서를 사용하면 조합 논리함수를 곱의 합 형식으로 만들어낼 수 있기 때문에 여러 개의 게이트
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  • 등록일 2013.07.01
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정리를 이용 Y=B+BC+ABC =B+BC+BC+ABC =B(C+)+BC(+A) = B+BC ② 카르노 맵 이용방법 Y AB C 00 01 11 10 0 0 1 0 0 1 0 1 1 0 Y= B+BC 1. 부울대수 2. 부울대수의 기본공리 3. 부울대수의 제반 정리 4. 조합논리회로 5. 카르노 맵(Karnaugh Map) 6. 간략화해보기
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  • 등록일 2010.04.25
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때의 차이를 구별하면서 기능표를 확인할 수 있었다. 1. 목적 2. 이론  가. 반가산기(Half Adder)  나. 전가산기(Full Adder)  다. 산술논리 연산장치(Arithmetic and Logic Unit, ALU)  라. 7-세그먼트 디코더 (7-Segment Decoder) 3. 예비보고
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  • 등록일 2014.03.16
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1 1 (c) NOT 게이트 입력 출력 A B Y 0 0 1 0 1 1 1 0 1 1 1 0 (d) NAND 게이트 입력 출력 A B Y 0 0 1 0 1 0 1 0 0 1 1 0 (e) NOR 게이트 입력 출력 A B Y 0 0 0 0 1 1 1 0 1 1 1 0 (f) Exclusive-OR 게이트 조합논리회로의 설계 우선 원하는
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  • 등록일 2009.06.10
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회로, 또는 등가의 NOR-NOR 회로를 그림으로써 논리회로(logic circuit)를 구할 수 있다. 식에서, 각 괄호 안의 +항은 3 input OR 게이트를 나타내고, 각 괄호들 간의 product는 3 input AND 게이트를 의미한다. 그러므로 Fig. 2-27과 같은 OR-AND 논리회로를 그릴
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  • 등록일 2006.05.13
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논리게이트와 부울대수 3.1 논리연산과 논리게이트 3.2 부울대수 3.3 부울함수의 정규형 및 표준형 제4장 부울함수의 간소화 및 구현 4.1 개요 4.2 카노우 도표 방법 4.3 NAND 게이트와 NOR 게이트를 이용한 구현방법 제5장 조합논리회로 5.1 개요 5.2
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  • 등록일 2009.03.27
  • 파일종류 아크로벳(pdf)
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