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차동증폭기의 출력 파형을 관찰하고 입력에 관한 출력 파형의 위상을 알아본다
위상이 같은 두 개의 입력 신호에 의한 차동증폭기의 출력 파형을 관찰한다. 1. 실험 목적
2. 배경 이론
3. 사용 계기 및 부품
4. 실험 절차(시뮬레이션
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선택하고 Properties를 누른 후 위와 같은 작업을 한 후, OK → Exit를 누른다.
⇒ 회로가 다 그려지면 파형을 얻고자하는 위치를 Probe tool로 지정한 후 RUN 키를 누른다. 전자회로.
1.실험목적
2.실험원리
3.시약및 기구
4.실험방법
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차동 증폭기 P-spice 시뮬레이션 수행 결과
회로도 )
시뮬레이션 결과 1) V3=V4=0.5Vp-p 인가했을 경우 ->Vout=0V
시뮬레이션 결과 2) V3=0.5V, V4=0Vp-p 인가했을 경우 -> Vout=4.5V
시뮬레이션 결과 3) V3=0V, V4=0.5Vp-p 인가했을 경우-> Vout =4.5V
시뮬레이션 결
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실험 기계 및 부품
① DC power supply(Dual) - 1
② AF Generator - 1
③ Oscilloscope - 1
④ IC : μA 741 - 1
⑤ 저항 : 1 kΩ - 2
2.2 kΩ - 1
10 kΩ - 1
108 kΩ - 1
47 kΩ - 1
22 kΩ - 1
⑥ 콘덴서 : 1 μF - 2
4. 시뮬레이션
⑴ CMMR 시뮬레이션 회로도
(2) Slew rate 회로도 1. 목적
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대한 민감성과 회로의 불안정성은 높은 주파수 대역에 영점을 위치시켜 위상 여유를 크게 하므로 보완될 수 있다
미분 커패시터 C1과 직렬로 저항 R1을 연결하여 쉽게 구현 1. 실험 목적
2. 관련 이론
3. 실험 기기 및 재료
4. 실험 회로
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