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회로의 입력
- H0~H3는 회로의 출력
- IR, IL은 직렬입력
- 회로의 동작표는 Function table에 보여진다
그림 4-12 4-비트 조합회로 시프트 *마이크로-오퍼레이션
레지스터 전송과 마이크로 동작
레지스터 전송
논리 마이크로 연산
시프트
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1.실험 목적
● 드 모르간 법칙을 소자를 이용하여 실험적으로 증명한다
● 드 모르간 법칙을 이용하여 부울대수 변환 및 논리회로를 간소화하는 능력을 익힌다
● 논리소자의 동작을 이해한다
2.실험 이론
드 모르간의 법칙은 조합논리
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ab 가 01,11 이며, cd 가 11 인 경우 : bcd
그러므로 f = ac\'d\'+ab\'d\'+a\'cd+bcd 가 됩니다.
REPORT
(카르노도 정리)
학과:방송영상산업학과
학번:99171035
성명:윤종순
과목:디지털 공학
교수님:권영해
제출일:03.11.24 1. 조합논리회로
2. 순차논리회로
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회로를 간략화 하는 방법이다. 진리표 또는 논리식을 보고 카르노맵을 이용하여 간략화를 한다.
2) 부울대수와 논리회로
부울대수를 이용한 논리 회로 분석의 절차는 첫째, 논리회로에 대한 부울 함수를 유도한다.
둘째, 유도된 부울함수로
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부울대수 F=(A+B)(A+B)를 설계하고자 할때 NOT,AND,OR 소자를
이용하는 방법, NAND 소자만으로 설계하는 방법, NOR 소자만으로 설계하는 방법, 이렇게
3가지의 방법이 있음을 알 수 있었다. 그러나 무엇보다도 부울식을 간략화 하여 회로를
설계한다면
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회로는 1의 개수가 홀수이면 1을, odd parity 회로는 1의 개수가 짝수이면 1을 출력하기 때문에 위와 같이 정리할 수가 있다.
위의 실험에서의 부울대수 F=(A+B)(A+B)를 설계하고자 할때 NAND 소자만으로 설계하는 방법, NOR 소자만으로 설계하는 방법이
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조합논리이다.
④ XNOR은 XOR의 보수를 구할 수 있다.
(∵ 왜냐하면 카르노 맵으로 표현 가능한 모든 논리회로는 NOR이나 NAND 만으로 표현 가능하기 때문이다. ) 부울대수의 정리
예비 보고서
1. 실험 목적
2. 기본 이론
3. 실험 방법
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부울대수와 드모르간의 정리
1. 그림1과 같은 회로를 각각 결선하고 입력 변화에 따른 출력 X, Y, Z 의 값을
측정하여 표 2를 완성하여라.
2. 그림2와 같은 회로를 구성한 후 두 개의 출력 X와 Y에 대한 이론값과 실제값을
비교 분석
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회로 동작을 기술한다.
③ 사용할 플립플롭을 결정하고 입력조건을 결정하는 표를 만든다.
n개의
외부출력
m개의
외부출력
조합 논리 회로
플립플롭
(기억회로)
④ 플립플롭 입력 조건에 따른 논리 대수식을 구하고 회로를 그린다.
2) 플립플
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논리회로
기본 논리연산 /
부울대수,카르노 맵 간단화 /
드모르간 정리
논리회로
기본 논리연산
❖ 논리 게이트는 컴퓨터를 구성하는 기본 블록이며 컴퓨터의 대부분의
기능은 메모리 형태의 유형을 제외한 대규모의 집
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