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저, 2009),
네이버백과(http://100.naver.com) ‘테브난의 정리’
< 참 고 문 헌 >
기초전기전자시험 / 김상배 저 / 흥릉과학출판사 / 2009
회로이론(7판) / 제임스닐슨 저 / PEARSON / 2005 < 목 적 >
< 실 험 방 법 >
< 실 험 이 론 >
< 참 고 문 헌 >
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방정식을 세워 베이스, 콜렉터, 에미터의 저항을 h파라미터로 나타내면 다음과 같다.
, , , ,
3. 시뮬레이션 결과 및 분석
1) 실험34 : 4단자 회로망
1) 전류치
실험 회로도
시뮬레이션 결과
분석 : 우선 I1이 0.5mA다 될 때의 V1의 값을 찾기 위하여 D
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저항, 각종 배선도구 등등)에서 조금씩 생기는 오차라고 생각 됩니다.
실험을 통해서 확인해 본 이 중첩의 원리를 다른 수업(회로이론 등)에서 적용하여 좀 더 쉽게
문제를 풀 수 있을 것이라고 생각됩니다. 또한, 이 방법을 이용하여 복잡한
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수 있다.
출처 : 교재 본문, 기초전기전자실험(김상배 저, 2009),
네이버백과(http://100.naver.com) ‘테브난의 정리’
< 참 고 문 헌 >
기초전기전자시험 / 김상배 저 / 흥릉과학출판사 / 2009
회로이론(7판) / 제임스닐슨 저 / PEARSON / 2005
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회로
A. 그림 1-(b)처럼 회로를 연결한다.
B. A-B 단자 전압 VAB를 측정한다.
C. 그림 1-(c)처럼 회로를 연결한후, A-B 단자의 합성저항 RAB를 측정한다.
D. 그림 1-(e)처럼 회로를 연결한 후, 6Ω에 흐르는 전류를 측정한다.
E. 이론값과 비교한다.
2. 노튼
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이론만 가지고 있는 허울뿐인 지식을 가진 공대생이 아닌 이론과 실전을 겸비한 실전에서도 유용하게 이론을 적용할 수 있는 공대생으로 거듭날 것 같다. 1. 제 목 : 직병렬회로, 테브난의 정리
2. 실험 순서에 따른 측정 값
3. 측정값
<
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저항
12k(1/2-W, 5%) 1개
인덕터
100mH 2개
5. Pspice 회로구현
실험 38. RC 시정수
1. 실험 목적
(1) 교저항을 통하여 캐패시터가 충전되는 시간을 실험적으로 졀정한다.
(2) 저항을 통하여 캐패시터가 방전되는 시간을 실험적으로 결정한다.
2. 관련이론
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PRENTICE HALL Robert L.Boylestad Louis Nashelsky Ⅰ목적
(1) JFET 증폭기의 바이어스 회로를 고찰한다.
(2) FET 소오스 접지 증폭기의 특성을 조사한다.
(3) FET 드레인 접지 증폭기의 특성을 실험한다.
Ⅱ이론
(1)바이어스 회로
(2) 접지방식에 따른
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저항 제어
㉢ 계자 제어
③ 동기 전동기
효율, 역률 좋다.시멘트 공장
제동법
① 발전제동
열로 소비
② 회생제동
전원측으로 반환
③ 역상제동(플러깅)
역토오크 발생 (급정지)
<제 4장. 전기 철도>
① 표준궤간(G)
1435[㎜]
② 고도(Cant. h)
곡
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회로에서 저항의 크기와 전류의 크기, 그리고 그 저항에 따른 전압의 세기가 비례한다는 사실을 실험 결과를 통해 확인 할 수 있어서 매우 의미 있는 실험이었다. 직류 직렬 회로에 관한 이론적인 지식을 정리하고 적용 할 수 있는 유익한 실
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