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실험과정 ③
실험과정 ④
5. PSpice Simulation
PSpice를 통해 Simulation을 해본 결과 위와 같은 그래프를 얻을 수 있었다.
위 그래프를 보면 제너항복이 일어나는 제너전압 는 -5~-4 V 정도 임을 알 수있다. 1. 실험 제목
2. 실험 목적
3. 기초 이론
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, 교문사 p.394
⑤ http://physica.gsnu.ac.kr/PhysEdu/modexp/Pelect2/main.htm
⑥ http://www.sejon.or.kr/simpl/si_c/11_yamamodo/11y04_02.shtml
⑦ http://www.mathtown.pe.kr/Dk/D1067.htm Ⅰ. 실험 제목
Ⅱ. 실험 일자, 목적
Ⅲ. 실험 이론
Ⅳ. 실험 기기 및 방법
Ⅴ.예비고찰
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결과
*실험결과* 표 4.7
C
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실험 5. 감산기 예비 레포트
[목적]
1. 반감산기
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기초실험(상학당) p19~24
기초전기전자공학실 - (주)교학사
http://blog.naver.com/mgchun72?Redirect=Log&logNo=50000781803
http://blog.naver.com/ghostgod2000/60075235616
http://ask.nate.com/qna/view.html?n=3922464
http://blog.daum.net/grs703/5
http://blog.daum.net/skadkfl12/3750744
http://blog.daum.net/
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실험이 되었다. PID 지식 이외에 회로 관련 지식 등 실무 담당에서 필요한 지식들을 더 공부 해야 한다는 것을 실험을 통해 알 수 있었다. Co-work으로 하는 실험으로 화공전반의 실무경험을 예비체험 할 수 있어 좋은 계기가 된 것 같다. 1. 실
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결과로 얻은 측정치를 통해 전체 집단을 미루어 짐작하고, 그것을 기초로 하여 두 사람 이상의 행동을 비교하고자 하는 체계적 절차이다. 일반적으로 많이 쓰이는 표준화 검사는 학력검사, 지능검사, 적성검사, 인성검사 등이 있다.
Ⅳ. 참고
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결과] 24장. MOS-FET 공통 소스 증폭기
실험 목적
[실험 장비 및 재료]
[기초이론]
(1) 증가형 MOS-FET
● 감소형과 증가형
(2) 공핍형 MOS-FET
(3) JFET의 바이어스
1) 자기 바이어스
2) 게이트-소스 전압
3) 자기 바이어스선
4) 소스 저항
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(Code Letter) : G
- 정격전압, 정격주파수 전원 직접 인가, 구속시 돌입전류의 예상치 제시
- 표 5.9 : 마력당 구속회전자 KVA
-실험에 쓰이는 3상 농형 유도전동기- 1 실험 목적
2 이론
3 실험장비, 부품 및 재료
4 실험내용
5 예비보고서
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발생기의 출력이 -2V ～ 2V, 10㎑ 정현파이고 출력에 10㏀ 저항이 아래 그림과 같이 직렬로 연결되어 있다. 51Ω에 -2V ～2V, 10㎑ 정현파가 걸리도록 점선 안에 들어갈 회로를 Op-Amp를 이용하여 설계하고 PSPICE로 simulation한 결과를 제출하라.
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실험 방법
높은 고온으로 설정
낮은 온도 (1번과 온도차를 이용함)
각 버튼을 누르고 각 실험치를 구함
버튼을 누르고 그에 맞는 수에 맞춰줌
전체적인 장비구성도
5. 결과
실습장 : 실온 26도
온도(‘C)
E (mV)
T (mV)
J (mV)
K (mV)
91
0.529
2.525
3.100
2.409
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