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multi is
port( a : in unsigned (1 downto 0);
b : in unsigned (1 downto 0);
result : out unsigned (3 downto 0));
end entity;
architecture arc of multi is
begin
result <= a * b;
end arc; Decoder(4bit BCD)
Multiplexer(8비트)
Encoder(4bit)
Comparator(4bit)
Multiplier(2bit)
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Encoder
- Decoder
- Multiplexer
- 7-Segement
5. Simulation
실험1) 4 to 1 MUX
실험2)Dip S/W 0~9 입력에 따른 7-segment LED
실험3) Encoder 설계
실험4) Decoder 설계
6.Experimental Results
실험 1~4
A. Data
B. Discussion
7. Analysis
8. Conclusion
9. Re
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Encoder의 원리를 이해할수 있었고 이것을 응용
하여 10진수를 2진수로 변환시키는 10진2진인코더, 10진수를 BCD code로 변환
시킬수 있을 것이다.
네 번째 실험은 세 번째 실험의 Encoder의 반대되는 Decoder를 제작하는 실험으
로 Encoder의 Input과 Output을
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세 번째 실습은 함수 F(A,B,C,D) = ∑m(0,2,3,8,10,11,12,14,15)를 이해하고 이를 VHDL로 알고리즘을 짜 8 to 1 MUX를 이용한 회로와 4 to 16 Decoder를 이용한 회로로 나타내는 것이다. 이 때 각 회로에는 En이 인풋으로 포함된다. MUX와 Decoder의 구조를 이해하여
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Encoder/Decoder 의 설계
본론
2.PC의 직렬 포트 (RS-232)
2.1 RS-232의 신호 레벨 결정
2.2 PC의 신호 레벨의 조절 ( MAX232 )
2.3 전압 레벨
2.4 MAX232와 PC직렬 포트와의 연결
3.1 1.8432MHz 의 오실레이터 사용
3.2 HBE-DTK-20k240 FPGA 트레이닝 키트
3.3 VHDL로
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입력과 전 단계에서 발생한 자리올림수를 더하도록 구성
- 두 개의 반 가산기와 한 개의 논리합 회로를 이용하여 구성
- 자리올림수를 더해 줄 수 없는 반 가산기의 단점을 보완 1. GATES(AND, OR, NOT, XOR)
2. DECODER
3.MUX(Multiplexer)
4. ADDER
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것은 집적회로화되어 있다. PCM통신에서는 아날로그디지털 변환기를 코더라 한다.
4. 참고 자료
-VHDL을 활용한 디지털 회로 설계 (한울출판사)
-네이버 백과사전 1. 개 요
2. 문 제
(1) 3*8 Decoder
(2) 3*8 Encoder
3. 고찰 및 의견
4. 참고 자료
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인코더의 입력과 디코더의 출력을 명시한 진리표를 작성하라.
4. 실험(회로도)
가. 디코더 회로를 실험보드에 구성하고 디코더의 출력에 LED를 연결하여 디코더의 입력을 변화시키면서 디코더 출력을 조사하라.
나. Encoder의 입력에 Decoder의 출
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논리회로의 조합으로 구성되며 대표적인 기능을 갖는 것은 집적회로화되어 있다. PCM통신에서는 아날로그디지털 변환기를 코더라 한다.
4. 참고 자료
-VHDL을 활용한 디지털 회로 설계 (한울출판사)
-네이버 백과사전
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. (n × 2n 디코더)
■ ROM, RAM과 같은 기억 장치에서 특정한 번지를 선택한다던가 명령 레지스터에 들어 온 명령을 해독하는 데 사용. 실험목적
[1] 디코더(Decoder)
[2] 인코더(Encoder)
[3] 멀티플렉서(MUX)
[3] 디멀티플렉서(DEMUX)
[4] 참고
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