목차
1. 회로도
1) 4SC counter
2) M_write, r, p
3) AR
4) PC, PC Control
5) DR
6) AC
7) AC Control
8) INPR
9) IR
10) IR Decoder
11) TR
12) OUTR
13) Flip-Flop
14) SC Clear
15) BUS Control
16) ALSU
17) Memory Address Decoder
18) Bit Cell
19) 16bit MEMORY 전체 회로도
20) Memory 부분확대
2. TIMING DIAGRAM
3. MEMORY 초기 DATA
4. Assembly 명령어
1) 4SC counter
2) M_write, r, p
3) AR
4) PC, PC Control
5) DR
6) AC
7) AC Control
8) INPR
9) IR
10) IR Decoder
11) TR
12) OUTR
13) Flip-Flop
14) SC Clear
15) BUS Control
16) ALSU
17) Memory Address Decoder
18) Bit Cell
19) 16bit MEMORY 전체 회로도
20) Memory 부분확대
2. TIMING DIAGRAM
3. MEMORY 초기 DATA
4. Assembly 명령어
본문내용
주소 해당 명령어 저장되어있는 BINARY CODE
0 LDA DA1 0010 0000 0000 0100
1 STA DA2 I 1011 0000 0000 0011
2 HLT 0111 0000 0000 0001
3 DA1, DEC 5 0000 0000 0000 0101
4 DA2, DEC 10 0000 0000 0000 1010
5 DA3, DEC 0 0000 0000 0000 0000
위의 어셈블리 명령을 Gate level에서 CPU 시뮬레이션 합니다.
0 LDA DA1 0010 0000 0000 0100
1 STA DA2 I 1011 0000 0000 0011
2 HLT 0111 0000 0000 0001
3 DA1, DEC 5 0000 0000 0000 0101
4 DA2, DEC 10 0000 0000 0000 1010
5 DA3, DEC 0 0000 0000 0000 0000
위의 어셈블리 명령을 Gate level에서 CPU 시뮬레이션 합니다.
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