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조합 논리회로가 필요 없을 정도로 회로가 간단하다.
(동기식 카운터에 비해 회로가 간단해 진다)
단점 : 플립플롭들은 동일 클럭에 변하지 않고, 한 플립플롭의 출력이 다른 플립플롭의 클럭으로 동작하기 때문에 지연시간이 길어지게 된다.
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반감산기
정의
반감산기(HS : half subtracter)는 2개의 1Bit 2진수 A에서 B를 빼서 그의 차(difference:D)와 자리 빌림수(borrow:Bo)를 출력하는 논리연산회로이다.
(A는 피 감수이고 B는 감수이다.) 반감산기
전감산기
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산기는 2개의 한자리 2진수 A,B를 감산할 경우의 논리회로를 말하며, 출력변수들은 차(D:difference)와 빌림수(B:borrow)로 나타낸다. 전감산기는 뒷단의 위치에 빌려준 1을 고려하며 두 비트의 뺄셈을 수행하는 논리회로로서, 림수(borrow) 입력을 취급
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산기도 설계를 할 수 있다.
● 카르노맵
▶ 카르노맵은 부울대수를 간단하게 할 때 편리하게 쓸수 있다.
▶ 간소화 방법
최소항의 값이 1인 경우 카르노맵에 표시
서로 이웃한 ‘1’들을 묶는다. ( 16 > 8 > 4 > 2 )
묶을 때 맵은 평면이 아
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논리회로이다. 따라서 현재의 디지털 컴퓨터는 스위치를 켜거나(1) 끄는(0) 상태로서 전기가 흐르거나 흐르지 않는 형태로 2진법의 1 비트(Bit)를 구현한다.
하지만 물리학의 양자역학 원리를 이용한 양자컴퓨터는 기존과는 전혀 다른 원리로서
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Data
4. 문자 Data
5. 기타 Data
논리회로
1. Boole과 Boole 대수
2. 논리 회로와 Boole 연산식
3. 반가산기(Half Adder)
데이터 구조
1. 배열(Array)
2. 포인터와 연결 리스트
3. 스택(Stack)
4. 큐(Queue)
5. 데크(Deque)
6. 트리(Tree)
7. 그래프(Graph)
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통 클럭에 의해 트리거될 때, 래치의 출력이 직접적으로나 조합논리를 지나서나 자신 또는 다른 래치들의 입력이 될 수 없다.
플립플롭 회로는 공통 클럭에 의해 동작하는 순차회로의 일부로서 순차회로가 잘 동작하도록 설계되어야 한다.
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새 IC칩으로 하지 않는 이상은 이런 문제가 해결되기 힘들지 않겠나 생각된다.
◎ 참고문헌
디지털 논리와 컴퓨터 설계 (M.Morris Mano저) 1.목적
2.이론
3.간단한문제
4.실험기기 및 부품
5.실험방법
6.이론치및예상결과
7.참고문헌
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1중 1이 홀수 개이면 결과는 1이 된다.
X
Y
C1
S
C
0
0
0
0
0
0
0
1
1
0
0
1
0
1
0
0
1
1
0
1
1
0
0
1
0
1
0
1
0
1
1
1
0
0
1
1
1
1
1
1
<진리표>
<논리회로>
S = XYC1
C = XY + (XY)C1 <논리식>
위의 논리회로에서 보듯이 전가산기는 반가산기 두 개로 이루어져 있다.
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논리 IC) - AND, OR, NOT 등의 논리 회로를 조합한 IC
③메모리 IC(기억 IC) - 디지털 신호의 0 과 1을 기억할 수 있는 flip-flop 등의 회로를 조합한 IC
④아날로그 IC(선형 IC) - 전압 및 전류가 연속적으로 변화하는 양(아날로그 신호)을 증폭, 변조하거나
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